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EDA365电子工程师网»技术社区 › 电子技术社区 › QA检查（免费服务） › 2017年11月18日QA检查报告节选
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2017年11月18日QA检查报告节选

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发表于 2017-11-20 10:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.跨分割了
( t% g3 H6 m* e ( q) c2 h# ~+ ?+ S# n& `( v0 u
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 楼主| 发表于 2017-11-20 10:19 | 只看该作者
2.高压电源地做隔离
1 G5 l' y& M' b3 V" y
( ]/ v1 D& c  R: p1 @7 x/ Y

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 楼主| 发表于 2017-11-20 10:19 | 只看该作者
3.SDRAM没等长
+ w% F6 y! O- \7 A" e/ F . Y  n- `( z- U: u

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
4.差分走线未按要求走线
0 m. K) l( Q1 R; p& y/ T7 H 9 E5 h, ]* R, F$ B! m

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
5.USB的ESD器件离接口太远了，布线先过ESD。# @. o+ d- @# ?- P2 \# n0 R9 v  O6 r
; H; ]( O. W) l6 K4 A" L$ _- r3 H- _

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
6.有线在RF挖空区过了，参考层不完整" _! H) B# \) z, d6 i
; g( }8 K5 Z8 ?$ @

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
7.400V？没有按照安规做间距隔离
/ d5 a4 x" c/ @3 n5 b+ ]
1 y% J2 {( R0 p; O% m9 m" F

点评

edapcbsyc
安规应该做多大隔离呢？  详情 回复 发表于 2017-11-20 21:28

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
8.封装库记性与原理图不一致9 @  g7 M$ B  r1 L) J

; a# f) q2 Y7 R3 x

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
9.VIA的隔离盘太大，导致内层多处出现隔断，而且隔断区有走线; o1 `, y1 m8 c0 Y$ D; a

5 P8 g7 X9 Z, |: ~9 A6 B

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
10.等长处理
8 s$ z  y! J  q3 }! R% Y
$ Z3 B1 S: H, C

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 楼主| 发表于 2017-11-20 10:22 | 只看该作者
10-1.等长处理+ Q+ k9 ~9 G  |) i8 n$ L6 G6 }

' f# n2 A: S  \4 u' }6 n

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发表于 2017-11-20 21:28 | 只看该作者
EDA365QA 发表于 2017-11-20 10:21
, Z- D* \4 j$ `) k+ a7.400V？没有按照安规做间距隔离

2 m+ l; Q6 p- Q: ]( x. R( T7 |7 V安规应该做多大隔离呢？0 |' o# h! }* m" v; Q2 e: I

" h+ f0 C/ Y0 ?6 U" X

点评

edapcbsyc
谢谢解答  发表于 2017-11-22 16:20
EDA365QA
可以参考：https://www.eda365.com/thread-146811-1-1.html  详情 回复 发表于 2017-11-21 09:06

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 楼主| 发表于 2017-11-21 09:06 | 只看该作者
edapcbsyc 发表于 2017-11-20 21:28% I* P. R. v7 a8 X
安规应该做多大隔离呢？

/ f5 H4 F2 g+ N: M' D7 n8 g8 S可以参考：https://www.eda365.com/thread-146811-1-1.html/ _; ^; s) O+ g

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qilinwang66

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发表于 2017-12-4 09:38 | 只看该作者

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