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ddr3等长问题

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发表于 2017-9-2 21:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
1.fly-by拓扑的ddr3的dqs跟其对应的clk需要等长否,如需等长,等长做到多少?(如颗粒1的dqs1根其对应的时钟(控制器-颗粒1)& I3 a, \, M, l3 U7 Q' g+ y) X- n
2.一个控制的两个通道,两个通道的clk是否需要对应等长,就是控制到两个通道对应的颗粒的那段clk,如需要等长做到多少?
7 W: I' ?, P4 K, O5 ^. k
7 g1 u" f  L+ w% I7 D
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发表于 2017-9-3 07:49 | 只看该作者
1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求

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150ps  详情 回复 发表于 2017-9-4 09:35

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发表于 2017-9-4 09:35 | 只看该作者
xxzouzhichao 发表于 2017-9-3 07:491 y4 e& d2 Y) o6 g; o' ^
1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求
* v1 E% W8 ^  o3 M. i% N
150ps
& T; B' d& n$ Y+ c" e

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具体换算到mil怎么换算呢  详情 回复 发表于 2017-10-20 14:34

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发表于 2017-9-5 18:53 | 只看该作者
我冒泡来解释一下:
3 w' |. W: D1 S4 ?1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,195)@1866,南亚NT5CB128M16HP要求(-225,225)ps@1333,布线需要综合考虑实际跑多少的频率,还有兼容不同颗粒的要求,取一个保守值最好,能做到+/-100ps以内最好
" Q6 h' |" U8 v2、flyby的拓扑结构,不需要走等长,这个靠初始化序列校验来保证。但要保证tDQSCLK在规范之内。
# n* H) Y. C3 s0 D) r5 r0 p+ i% t' {( Z
( Y- T! Z" i, t# c0 y: \+ _& h

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你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?  详情 回复 发表于 2017-9-6 10:12

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发表于 2017-9-6 10:12 | 只看该作者
hagelee 发表于 2017-9-5 18:53
. E( J, H/ {+ h3 E, f2 K3 z; g我冒泡来解释一下:" V+ h8 P( j, H& ]. T
1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,19 ...
6 M! N& H2 d( ]6 q0 {" @
你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?: `7 K" \" S) Z0 p6 g! u3 ~. u0 J# g

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一个ps 6mil ,150ps ,900mil  详情 回复 发表于 2017-9-6 11:17

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发表于 2017-9-6 10:43 | 只看该作者
控制等长的目的也是为了保证timing的余量;走线和延迟的计算公式 V=C/sqrt(Er) ; O0 Y! S8 Q  q( e1 Z& C, m" J, U
1.内层周围介质均匀,Er取4.2-4.5,C光速约12inch/ns,计算后为V=166ps/inch;
% D9 x. e" x; a9 l( z" h2.表层由于暴露在空气中,Er小于4,传输速度比内层快,大约 140ps/inch;
. ]7 t% n/ {% m! y/ @4 K# V& m" k. ^考虑到温度,电压,颗粒的差异,预留一定的余量可以避免问题的产生,我认为能控制在+/-1inch之内,基本能够保证时序的要求了。
( q# y* h! g1 T* s% f0 g. Y" u  _. x8 J, v
还有一种情况是板子结构特殊,布板确实无法做到1inch范围之内,可以考虑通过绕线增加1个ck的周期;这个主要是跟芯片设计的DDR PHY有很大关系,当然这个需要厂家确认。
. O; o( z$ O4 M5 @, f+ Y$ Q; d

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发表于 2017-9-6 11:17 | 只看该作者
cewtf 发表于 2017-9-6 10:12
  a; M0 e* H1 g& r你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解 ...

. j5 C6 J7 r) _  E& V& o6 r8 o一个ps  6mil   ,150ps   ,900mil
4 c% p( m" A" S

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 楼主| 发表于 2017-9-6 20:52 来自手机 | 只看该作者
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,dqs跟时钟是不是是要完全等长呢,只有一个clk

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位宽多少?  详情 回复 发表于 2017-9-8 18:08

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发表于 2017-9-8 16:57 | 只看该作者
dqs与数据做等长,clk走t型,地址线走t型做等长

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发表于 2017-9-8 18:08 | 只看该作者
ann_wz 发表于 2017-9-6 20:524 W  r  [5 D" h4 M! ?
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,d ...

# P4 W/ w; k- }" F位宽多少?

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 楼主| 发表于 2017-9-9 07:47 来自手机 | 只看该作者
8片+ecc 72位数据,跑800m速率

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居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了  详情 回复 发表于 2017-9-9 21:11

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发表于 2017-9-9 21:11 | 只看该作者
ann_wz 发表于 2017-9-9 07:47" y( d. ~& x3 R* L+ G3 v, x
8片+ecc 72位数据,跑800m速率

: b1 X$ P( n; V- `2 e# L居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了8 x1 k8 B8 M. D0 L+ M) a1 X& t$ k! ?; i

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发表于 2017-10-20 14:34 | 只看该作者
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具体换算到mil怎么换算呢" O) Y- Q/ v/ v$ _7 B
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