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EDA365电子工程师网»技术社区 › 电子技术社区 › FPGA/ASIC/CPLD论坛 › DDR在800M工作时钟下不link
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DDR在800M工作时钟下不link

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jacekysun

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发表于 2017-5-22 15:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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各位大神，在逻辑调试时发现一个单板在焊接RS422（LVDS插座不焊）的插座时，DDR在800M工作时钟下不link，在焊接LVDS （RS422插座不焊）时该问题不存在，逻辑问这个和pcb设计有无关系？单板是同一个单板，只是兼容方案，LVDS和RS422选其中一个功能。(附图中X4\X5的是LVDS插座，X6是RS422插座)，DDR信号没有跨分割的，麻烦各位大神指点一二，谢谢！
# T: r1 b! \- w" c0 ?  ^

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ayu1808

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发表于 2017-11-25 20:41 | 只看该作者
这个站一周前刚刚有了点起色

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