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lhycmyy_hawk 发表于 2016-9-25 16:46 6 }% R' ^7 A9 l8 G( n+ G, B- I2 z我的习惯是,顺序如下 ; h' l! B1 d) N! [& | N1,看layout guide# k% E( M1 `! ~4 J: ]0 g 2,看参考设计
fei 发表于 2016-9-26 09:14 2 r8 f) f) y: u8 u3 E9 p- `* G7 P收发分层走,能在内层尽量走内层。你的高速线是多少G.你问下硬件哪是收发好像命名没分清。
lhyy511 发表于 2016-9-26 09:07 / I5 N7 d1 ^- s# d; G0 N尽量满足硬件工程师需求吧
不期而遇 发表于 2016-9-27 09:33+ f- o" W% O t$ M2 T7 E' h" v: C1 W 同组同层好像是为了满足什么阻抗要求吧
小帅哥在江苏 发表于 2016-9-26 09:49
lc1234 发表于 2016-9-27 22:248 O) a$ u4 a$ F5 j5 L( X 呵呵
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