2M的速率，时钟线与数据线长度差3000mil引起数据丢失

xingzhang · 发表于 2008-9-28 12:01

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如题，最近布了一块通信单板，其中的E1业务，2.048Mbps，有三组信号的时钟线与数据线长度差了3000mil左右，现在调试时，发现这几路总是丢包。目前还在定位到底是我的PCB走线问题呢（因为是2M信号，速率不高，所以我没有做等长处理），还是FPGA逻辑设计时的时序问题？
请教：怎么根据传输速率确定数据线与时钟信号的走线误差，也就是在多少误差范围内数据不会出问题？

个人认为，像我的这个2M信号线与时钟线差了3000mil，时延大概也就是1ns左右，而2M的时钟周期远大于1ns，真的是走线不等长引起的数据误码？

dugujian00 · 发表于 2008-9-28 13:57

2M的速率，没必要等长吧
能不能再把速率再降低试下呢，
主要是要看你读、写数据时，你的时钟信号到位没？

sarryfu · 发表于 2008-9-28 14:53

原帖由 dugujian00 于 2008-9-28 13:57 发表 7 L# l: {3 Z, S: p" h
2M的速率，没必要等长吧! e0 V! _- G9 y! S; `8 G0 t% n
能不能再把速率再降低试下呢，0 {/ v3 k ?8 ~% n& S
主要是要看你读、写数据时，你的时钟信号到位没？

NOD

xingzhang · 发表于 2008-9-28 17:51

说来也奇怪，就那三路时钟，数据线相差3000mil左右的有误码和丢包，是很巧合，我现在正在设法验证，如果真是它们引起的话就麻烦了，在FPGA里面处理很难办。

回楼上两位的回复：虽然只有2M，但如果数据，时钟不同步，长期运行时数据也会丢。

以后布PCB一定要吸取教训，时钟与他配合的数据线做等长是没有坏处的...

rjc · 发表于 2008-9-28 18:43

时钟与他配合的数据线做等长
有高手说一下这话是什么意思吗？？谢谢

xingzhang · 发表于 2008-9-28 19:42

原帖由 rjc 于 2008-9-28 18:43 发表 , b$ `' f9 p2 b" a) B. [
时钟与他配合的数据线做等长
& M& d1 W1 h& O* b: \, E2 F4 b有高手说一下这话是什么意思吗？？谢谢

数据是按照时钟一拍一拍打出来的，有个对应关系，就这意思

sy_lixiang · 发表于 2008-9-29 06:28

吸取教训。。。不过我感觉也未必是没做等长的原因。。。2楼朋友说降一下速度试一下可行。。。

还有，看一下在什么时间开始丢包，大约也可以算出来吧。。。

ieracll · 发表于 2008-9-29 15:05

楼主说的是时钟线长，还是数据线长？

zyunfei · 发表于 2008-9-29 16:45

有三组信号的时钟线与数据线长度差了3000mil左右
看你说的不太明白！
要是时钟和数据线差没有什么关系
但是要是并行数据线间相差3000mil就会出问题了！
不要求严格等长但是不能相差太长，在板子上的延时和你理论上计算的相差很大的
你可以用si仿真下！

  丢包是每次都丢还是偶尔丢？
每次都丢说明你的板子或是你的FPGA时序有问题，偶尔丢说明你的设计中有干扰存在。

gaoshann · 发表于 2008-9-29 17:39

你那是什么呀可以差那么多，怎么走的线好有难度呀？

glater · 发表于 2008-10-6 16:51

不是很明白的！差3000MIL，很容易出问题的！

Haiou · 发表于 2008-10-6 20:09

原帖由 zyunfei 于 2008-9-29 16:45 发表
9 U- F; h+ c/ Q3 l, o有三组信号的时钟线与数据线长度差了3000mil左右
$ n( x! D% l: j9 J8 ]看你说的不太明白！9 Q4 p, d7 [8 ~2 S
要是时钟和数据线差没有什么关系/ G) T4 r4 q5 j0 w- h
但是要是并行数据线间相差3000mil就会出问题了！
3 V- h( L0 b9 C0 F9 g9 g' I 不要求严格等长但是不能相差太长，在板子上的 ...

分析的不错.

0201140114 · 发表于 2008-10-7 14:00

还是不是很明白!!郁闷啊!!

hunanwuxi · 发表于 2008-10-8 00:38

建议最好用示波器量一下信号
比较一下一般都能看出问题
如果有逻辑分析仪最好

dangelzsp · 发表于 2008-10-8 11:11

、、、

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什么东西可以差3000mil，俺们的板子要求5mil误差内

rule里整一个相对等长麻。。

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