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设计好的PCB如何检查等长的问题

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发表于 2015-9-25 14:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一个主IC挂两片DDR,主IC到DDR使用T型结构分出,要求是主IC分别到DDR的网络等长,设计的时候使用的是虚拟过孔,设计完成后如何检查符合要求。还有DDR3做等长200mil以内可以吗?
+ _5 c6 O# N6 \3 U$ I( x
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发表于 2015-9-25 15:28 | 只看该作者
设计完成后输出等长表格后,检查等长数据。
7 V8 `7 X$ J) h* U) o
9 w; }( E& ?1 O4 R: C地址线等长200mil没有问题。

点评

请问jimmy 输出等长表格是这个吗?  详情 回复 发表于 2015-9-25 23:13
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 楼主| 发表于 2015-9-25 23:13 | 只看该作者
jimmy 发表于 2015-9-25 15:287 j: U3 }& j9 G! z5 c" K5 u
设计完成后输出等长表格后,检查等长数据。
+ d/ x  b; P1 \8 o
# |* X) `$ b% {* Y1 T7 K# O地址线等长200mil没有问题。

1 H, [& H/ g2 I( }, T2 f1 r请问jimmy 输出等长表格是这个吗?
' H  N, k, q" r, d

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发表于 2015-9-28 09:47 | 只看该作者
对,是的( j: H7 n) ~  ]% @3 [

" I6 v7 _, g) t4 V% e( I详情可参阅《PADS9.5实战攻略与高速PCB》一书。+ L& @9 ]8 a1 S4 L: \7 v5 P
% c7 I! c6 s+ u
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发表于 2015-10-5 10:27 | 只看该作者
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