电气规则里面设置的等长为何跟pcb里面网络显示值不同？

mengzhuhao · 发表于 2015-8-31 21:26

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电气规则里面设置的等长为何跟pcb里面网络显示值不同？
首先我在电子规则的Propagation delay设置一个固定值，最大最小都是1900mil，单位我切换成mil

然后我在net里面的Propagation delay找到我要设置的网络，创建为匹配组；然后勾选上刚才设置的规则，然后点击analyze，打开相关的分析开关
在pcb我先随便把这些网络线拉完，然后我选择所有网络右键执行一个自动等长延迟的选项，等待数秒之后，在规则里面可以看到这样的情况

freeren · 发表于 2015-9-1 14:07

貌似等长是在这里设置

mengzhuhao · 发表于 2015-8-31 21:27

但我在pcb里面选择网络显示信息的时候发现这样的情况
难道没等长到设置的1900mil附近？

mengzhuhao · 发表于 2015-8-31 21:42

如何我要设置绝对等长应该注意哪些事项？

mengzhuhao · 发表于 2015-8-31 23:19

这个误差是不是还考虑了过孔的z方向的长度？像打孔的话有2个，就要算上2个过孔的深度？

mengzhuhao · 发表于 2015-9-1 00:00

mengzhuhao 发表于 2015-8-31 23:191 Q$ s$ T' v! j0 ^! q
这个误差是不是还考虑了过孔的z方向的长度？像打孔的话有2个，就要算上2个过孔的深度？

这里的设置会对布线有哪些影响？

像auto-interactive delay tune这个功能还能在哪里设置它的布局布线策略？感觉默认情况下走出来的有时候不是很好

是否有规则可以限制于规范它？

mengzhuhao · 发表于 2015-9-1 08:31

我定义了一根差分对的长度是3500mil，自动走完之后在规则管理器里面显示的是分别3488mil与3499mil

但是在pcb里面现在net查看的时候发现是4566mi与4595mil

这个又是怎么回事？

等长以规则里面的为准？那多出来的部分咋么解释，如果短了还能理解可能是叠层的原因这个是啥原因？