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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 原理图芯片封装分布出错，导不了网表，请求帮助！
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原理图芯片封装分布出错，导不了网表，请求帮助！

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yangmingen

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1#
发表于 2015-8-13 12:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
如下图，source packag ， source part 的值与其它分页的不一样，导网表报错：8 m4 ]! Q% x7 m# k9 T& U: |
1 z8 @( C) I8 B4 U7 Y8 ]* Y
Checking Pin to Port Connections
: C- K9 B. K( c4 R1 \* x2 i5 }4 O1 U6 G% J
Checking for Invalid References
; B& b* S7 `1 z% xERROR [DRC0026]   This reference has already been assigned to a different package type. U502:  SCHEMATIC1, 02.RX-LVDS&TX-MINILVDS  (1.72, 8.48) & u: g( {( e$ x9 N  \. Q  E, I

5 D* \, d% N( S" dChecking for Duplicate References1 w' e5 b& q: C7 G

- E# Q6 \+ |! X' R2 O; a. o$ [ ' f; y. \" c8 y( Q* t
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fallen

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2#
发表于 2015-8-13 13:42 | 只看该作者
同一器件的不同部分吗？! w( R1 z6 |& |, {
那么应该是位号要一样，后面再加ABCD....* V0 V' u' N4 i
9 p* j( m; R7 z2 ^) J3 k$ ?
另外你这个问题，可以从其他正确的地方复制一个过来，然后再改后缀。

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kevin890505

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3#
发表于 2015-8-13 15:18 | 只看该作者
把这个器件更新下就行了撒，或者直接替换为同一个源

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