pads9.3 logic封装管角命名不能重复？

gx177 · 发表于 2015-8-5 19:26

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各位好！
用的是PADS9.3 LOGIC画原理图，
LOGIC封装时，由于有很多VSS和VDD，
导致CAE 封装不对，
想问下，PADS9.3里管脚命名是不能重复的吗？？
谢谢！

饭牛 · 发表于 2015-8-6 08:44

没有严格禁止, 只是会警告, 如果嫌碍眼可以编个号, 区分开.

gx177 · 发表于 2015-8-7 14:31

饭牛发表于 2015-8-6 08:44
' u6 U0 T+ @; U' G( i没有严格禁止, 只是会警告, 如果嫌碍眼可以编个号, 区分开.

嗯谢谢您。
还想请教您一个问题，为什么在LOGIC中，有时候
我用SELECT ANYTHING 选中网络或走线，根本就选中不了，
需要先Select Net 才能Select 按thing 选中走线或者网络。

饭牛 · 发表于 2015-8-8 09:37

gx177 发表于 2015-8-7 14:310 x8 p6 j! \1 D! B; ^" r
嗯谢谢您。" s6 l# ]' P( E7 [4 n
还想请教您一个问题，为什么在LOGIC中，有时候
( M& A1 l, v% Y9 ^; j( `我用SELECT ANYTHING 选中网络或走线，根本 ...

没出现过这种现象, 你换一台电脑或重装一下排查.

gx177 · 发表于 2015-8-8 10:53

饭牛发表于 2015-8-8 09:37
8 R N- x# @6 E4 }( n没出现过这种现象, 你换一台电脑或重装一下排查.

恩。可能真的是我的电脑的问题

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