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关于AD芯片选型的问题请教

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发表于 2015-3-14 14:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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要设计一块8路AD同步(时间同步、相位同步)采集的板卡,分辨率≥14bit,采样率≥5Msps。AD数字输出进FPGA。AD9252是8路模拟信号进,8路数字信号串行LVDS输出;
! G) w4 Z6 k4 k6 Z& m7 U" pAD9251则是2路模拟信号进,2路数字信号并行输出(D0A-D13A、D0B-D13B)。5 q  v( k% S' M; @: \* B. m1 Z
理论上选择AD9252,一片即可;
3 [. c7 @, Z! I& z/ p* R& a选择AD9251,需要4片,要额外考虑芯片间同步问题。9 ~! r2 |5 r2 o. Y/ _) W
想请教下各位,如果串行LVDS输出,在FPGA内串转并时,是不是容易产生不同步的问题?如果并行输出,要多走不少线,芯片间的同步实现难度大不大?) j( |3 Z& s+ `& T# a
初次使用AD芯片,有类似开发经历可否麻烦给个参考电路或其他优选芯片。/ s) F% l- i1 ]3 i; J0 m! i
非常感谢!' |7 \4 S. R' \4 g. c4 a
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发表于 2015-3-14 23:22 | 只看该作者
本帖最后由 part99 于 2015-3-14 10:32 编辑
: v5 D6 L  N. h9 d. b; l) g  l( V4 R# D
并行时间同步好做一点,串行的同步在FPGA端有点麻烦。: T4 }& u1 ?8 ~! M8 U
不过,你的采样率不高,可以用9252,但如果PCB有位置,而且FPGA离AD芯片不远,最好还是选择并行。
  v: f7 k0 @6 ^$ p  u& w. j$ m如果你担心不同的芯片处理的速度不一样而影响同步,那么同一个芯片不同通道处理速度也有可能不一样,所以9252和9251是一样的。
7 V  e* T/ Y0 `/ o不要在找其他的AD转换芯片了,analog device 已经是业界最好的了。

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回答得很详细,非常感谢! 我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片间同步,如何保证4片AD9251收到的SYNC信号严格同步? 是利用FPGA的全局时钟直接输出4路SYNC信号,还是使用独  详情 回复 发表于 2015-3-15 23:14

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发表于 2015-3-14 23:26 | 只看该作者
如果用9251, 建议9251输入的时钟由FPGA打进来,而FPGA的采样时钟由9251的输出时钟来提供。

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发表于 2015-3-15 21:32 | 只看该作者
以前用过4个双路并行的AD7760,芯片有个同步管教,同步比较好做  9251没用过

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谢谢啦!AD9251也有个同步管脚  详情 回复 发表于 2015-3-15 22:58

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 楼主| 发表于 2015-3-15 22:58 | 只看该作者
戏出东方 发表于 2015-3-15 21:320 R: N1 ^  {# M  P
以前用过4个双路并行的AD7760,芯片有个同步管教,同步比较好做  9251没用过
7 u9 O3 z9 B  J: o3 j: _
谢谢啦!AD9251也有个同步管脚
5 d2 }/ F4 n/ ~4 x5 w

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 楼主| 发表于 2015-3-15 23:14 | 只看该作者
part99 发表于 2015-3-14 23:22. j7 Z2 l' A; c" u
并行时间同步好做一点,串行的同步在FPGA端有点麻烦。
$ `# E* [; m, o+ G2 V  R不过,你的采样率不高,可以用9252,但如果PCB有位 ...

" A3 P  @  h1 l5 O. K回答得很详细,非常感谢!
4 r* S$ y) J, t1 s; _, I我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片间同步,如何保证4片AD9251收到的SYNC信号严格同步?: ~3 B  N; w2 q1 \+ w% j
是利用FPGA的全局时钟直接输出4路SYNC信号,还是使用独立的时钟驱动芯片分路输出SYNC?如果使用FPGA全局时钟直接输出4路的话,假如20Msps的采样率,SYNC的PCB布线走等长,FPGA内部延时问题不大吧?
  x4 I8 A1 f  r+ Q/ D6 v. |3 d

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我也建议用FPGA出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可以忽略不计,但为了信号完整性,一定要走菊花链,或者加个同步的buffer。  详情 回复 发表于 2015-3-16 05:56

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发表于 2015-3-16 05:56 | 只看该作者
本帖最后由 part99 于 2015-3-15 16:58 编辑
; y. O2 F% B: k# @# V8 z/ {
zzzljb 发表于 2015-3-15 10:14
6 J& S0 n% x! G) [. F" B! X8 a回答得很详细,非常感谢!1 S! D8 Q3 L+ t, Y0 w( A
我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片 ...
) q7 x, M! E2 U! r
我建议用FPGA全局时钟出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可以忽略不计,但为了信号完整性,一定要走菊花链,或者加个同步的buffer。/ a  b1 d2 E) u! v

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非常感谢!  详情 回复 发表于 2015-3-16 10:17

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 楼主| 发表于 2015-3-16 10:17 | 只看该作者
part99 发表于 2015-3-16 05:56
! q9 @9 c% X; Q# s" a- i我建议用FPGA全局时钟出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可 ...

2 b7 o8 q: C2 m非常感谢!
% C' }* n! `% K' T; C

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发表于 2015-3-16 14:05 | 只看该作者
高大上的东东,赞一个。

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fallen兄又取笑我了,这种东西对你而言还算高大上啊 话说之前没留意fallen兄EDA365版主的头衔啊,新晋升的?  详情 回复 发表于 2015-3-18 22:18

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 楼主| 发表于 2015-3-18 22:18 | 只看该作者
fallen 发表于 2015-3-16 14:05
  u2 P* A! z1 w+ P2 d. `  c4 B: ~高大上的东东,赞一个。

- o+ E8 O" C7 w& h9 l8 s2 vfallen兄又取笑我了,这种东西对你而言还算高大上啊( O' |! ?" z; ~8 m9 {" C
话说之前没留意fallen兄EDA365版主的头衔啊,新晋升的?; k  ?- k. ^- g3 C: B1 d

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为人民服务的。  详情 回复 发表于 2015-3-18 23:16

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发表于 2015-3-18 23:16 | 只看该作者
zzzljb 发表于 2015-3-18 22:18
9 {6 U" G, N6 e. Q  Ffallen兄又取笑我了,这种东西对你而言还算高大上啊
! c, G4 K, i* o$ V$ a; n话说之前没留意fallen兄EDA365版主的头衔啊,新晋 ...
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