求大神：有个客户问，怎么用alium designer的原理图生成fpga的约束条件

史努比 · 发表于 2015-4-8 17:24

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如题，

史努比 · 发表于 2015-4-8 17:25

fpga的约束条件是不是可以是一个文件，altium designer 和cadence原理图是不是可以直接生成一个fpga的约束条件文件，可以直接导入fpga编程软件中去。

kuochiang · 发表于 2015-5-28 11:04

感謝分享~~

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