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原理图Design Rules Check后发现的错误怎么解决

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发表于 2014-9-12 16:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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有好几个错误类型,截取出来:
8 c1 L+ z+ p" s7 k7 r0 Z2 n: i+ L& QWARNING:  [DRC0004]  Possible pin type conflict P1,NCE Bidirectional Connected to Power
7 k9 Y) M( Q# F5 k; n% B# w$ P- Q                  SCHEMATIC1, FPGA_CONFIG  (320.04, 96.52)
; n/ ^, {. O9 ^+ \5 K# v9 EWARNING:  [DRC0007]  Net has no driving source N5154057
  i! `/ d2 \# v" o3 FWARNING:  [DRC0006]  Net has fewer than two connections N5154057
" A( o. m3 L+ A, MWARNING:  [DRC0040]  The off-page connector does not have any wire connected. PXI_LBL0
0 a" }) n: V" N: Z0 `: Y) [# xWARNING:  [DRC0038]  Visible unconnected Power Pins are connected to global nets X1,PXI_LBR5: T8 L8 l  E/ J
百度了一下,网友说04,06,07,40这几种错误是可以忽略,可是一直找不到38这种错误的解决方法。( W( a! f% P" U4 a. Y9 Y! y
求大牛给点指导,不胜感激!

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这个是设置

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发表于 2014-9-13 18:26 | 只看该作者
个人觉得WARNING问题不大,只要连接关系正确,然后package通过应该就没多大问题,只要没有Error就好……

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发表于 2014-9-15 10:10 | 只看该作者
设计规模上去之后,还是需要规则来好好约束的

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发表于 2014-9-15 12:19 | 只看该作者
這個問題犯了基本的低級錯誤. 有沒有關係 ... , 應該還好...不一定喔.7 l4 I$ K/ H- [7 e# M; \! T( Q
如果該訊號是輸出用  , 這很明顯線路設計是有問題的.
; u& S$ K1 V# t7 H$ T我猜應該是在 DRC metrics 裡面設定不正確導致有此問題.
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