allegro导入网表出错

咸蛋小坏人 · 发表于 2014-6-30 11:50

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求大神看看

hwixjj · 发表于 2014-6-30 13:18

器件少了4 5两个脚来自: Android客户端

topdreams7 · 发表于 2014-6-30 14:41

应该是网表不对吧，或者器件封装不对。

flyingc381 · 发表于 2014-6-30 14:43

封装少了4 5 脚

另外网表别放在中文路径下

咸蛋小坏人 · 发表于 2014-6-30 16:38

hwixjj 发表于 2014-6-30 13:18) K a8 l: B9 _5 V$ n+ W2 ^
器件少了4 5两个脚

谢谢，没有少，只是库里面有几个powerjack文件，而且管脚封装不一样，路径设置里面库的优先级不同，导致的错误，把路径重新设置一下就OK啦！

咸蛋小坏人 · 发表于 2014-6-30 16:40

flyingc381 发表于 2014-6-30 14:43- J4 v6 l6 r2 Q; I5 f* y
封装少了4 5 脚
# f& m, T5 @ d
# R. O, F! c" s2 s+ e$ w另外网表别放在中文路径下

谢谢，没有少，只是库里面有几个powerjack文件，而且管脚封装不一样，路径设置里面库的优先级不同，导致的错误，把路径重新设置一下就OK啦！你提示的对，cadence要求蛮多的，中文路径容易出错，还有一些符号之类的。

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