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Signal model 导网表报错,求解答!

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发表于 2015-9-7 14:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您!

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x
请问,Allegro Design Entry HDL 的原理图导pcb的时候,
* G4 D# P5 A: \, K; g( u, O! p报很多“Signal model 'R0ohms' not found; may effect xnets and electrical constraints.”的错。
8 n2 |4 ]( x# Q! g' c请问有没有方法不报错,或者不导模型的信息进pcb。1 L! S2 H6 B; L: h* f: W
. e1 P( J8 a' w) G% @
请知道的大神们解答我一下啦^_^; i$ ?( J5 [! t% J
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发表于 2015-10-11 09:35 | 只看该作者
START_ECSET_MODELS
& P4 G, I5 c0 n$ f( R0 H2 [& M. uretain_existing_xnets_and_diffpairs 'ON'( f( c# B7 _  D& F$ o
END_ECSET_MODELS
" O; m8 G, u5 p+ c
) h8 ?* }0 F: f2 }3 h: R工程文件cpm最后加上这个

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