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关于DDR3性的问题

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liaotingkang

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发表于 2012-12-31 11:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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大家好，附件是CPU-DDR3的控制器电路，如图中，  i1 E, |4 F% X4 F2 |: a8 [5 Z' X: S% [
DDR3_ZG  R3-240R的电阻的作用是强度调节的么，+ a% ^+ c4 q  T" p% z
DDR3_ODT0作用是什么？
; Y( J. R) h* {7 `9 K/ FDDR3_WEN 作用是什么？: j; L0 K; n3 ?$ A! L; t' ]" E
DDR3_RASN作用是什么？( ^0 B8 D# ~' M+ n4 N' ]
DDR3_CASN作用是什么？
& k1 V* X: A* k' _7 M2 }DDR3_CKE0 作用是什么？
& k4 R, e) N" ?1 ]7 O" ZDDR3_BA作用是什么？0 G/ F* H7 C: l5 U) @) J
MEM_SREN作用是什么？
+ s- x  w! T9 }3 ]

DDR3.png (78.82 KB, 下载次数: 3)

DDR3

DDR3
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kevin890505

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发表于 2012-12-31 13:50 | 只看该作者
DDR哪有太多要设计的    下一份DDR3规范  这些东西都是最基础的 里面都有讲  论坛里面有人上传，自己搜

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part99

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发表于 2013-1-1 11:10 | 只看该作者
{:soso_e112:}性的问题？？？

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liaotingkang

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 楼主| 发表于 2013-1-4 15:18 | 只看该作者
你有此DDR3规范 么？发给

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sphai

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发表于 2013-1-6 17:00 | 只看该作者
被性的问题引进来了。。。。。

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edajf
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发表于 2013-1-8 15:04 | 只看该作者
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