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【原创】Allegro的pcb设计流程!

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发表于 2007-11-23 09:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 紫菁 于 2017-9-14 11:40 编辑 # W/ R6 U. R/ h5 @
1 `3 J9 E6 M& A8 C  ]6 l% f
这个是自已制作的,没有什么水评,就是贴几个图和字而已,有什么错误的地方提出来啊!!!
游客,如果您要查看本帖隐藏内容请回复
4 m" f0 Z+ P8 ]

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发表于 2017-6-15 14:28 | 只看该作者
好东东                                                                                      

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发表于 2014-1-14 11:49 | 只看该作者
楼主啊!问你个问题!我根据你的步骤一步一步走!就是导入网表的时候没你那个(.tel 文件)晕死我了 他是不元件库里的文件吗? 还是什么问题啊?

QQ截图2014011401.png (123.13 KB, 下载次数: 0)

QQ截图2014011401.png

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发表于 2014-1-14 10:38 | 只看该作者
帖子是好的!但是版本才15.5  能不能再搞个16.0以上的!现在都很少用15.5的了!与时俱进啊

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发表于 2007-11-23 09:57 | 只看该作者
看了,真详细阿!支持原创!2 x  P3 I( K* e5 t% d" X3 T. c
. F; Y9 v+ j& p, T% y
[ 本帖最后由 SHADOW 于 2007-11-23 11:31 编辑 ]
changxk0375 该用户已被删除
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发表于 2007-11-23 10:10 | 只看该作者
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Allen 该用户已被删除
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发表于 2007-11-23 10:55 | 只看该作者
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发表于 2007-11-23 10:57 | 只看该作者
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发表于 2007-11-23 11:12 | 只看该作者
收下了,多谢

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发表于 2007-11-23 13:57 | 只看该作者
兄弟  俺按你老的意思去弄了下 ; R2 X- w6 s- h
有2个问题 :1、图纸的设置问题1 w0 [  K0 w/ n/ _' V- t5 b7 g# b
                      2、就是路径问题   这个俺老整不明白
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
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 楼主| 发表于 2007-11-23 20:12 | 只看该作者
1、图纸的设置问题????不知你说的是不是图纸设置大小的问题, 那么这个在这里设置,那个width和hight指的是,当你打开格点的时候能显示格点的区域大小.也就是你能布局布线的最大宽度和高度.我们一般不是说你的电路板外围(outline)多大就只设置多大,要留有一定的空间,也不能设置太大了,当放大和缩小比较麻烦,费时又费力.一般的电路板设置宽高为40000(mil),那个leftX和ldftY是指最左下角的那个点离原点的位置,大多数为负值,很少为零,设为-10000差不多了,我贴的这个图是不作参考.不面那个move origin用来移动原点的,如果你想把当前坐标(100 ,-50)处设为原点,你就可以在x,y的方框里输入这个坐标值.4 ~; \9 C7 ^9 j& y4 i# ~, A6 x0 W& p% L
2那个路径的问题, 点击Config_paths会出现这个图片,再点击devpath这个按钮, 出现这个对话框,这几个按钮自已去搞懂,选择你要的当前的库,再点击Design_path有两个路径要设置分别是padpath和psmpath,设置同上.

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发表于 2007-11-24 19:19 | 只看该作者
无语!!!!!!! :L :L :L :L :L :L :L :L :L :L :L :funk: :funk:
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
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发表于 2007-11-25 11:13 | 只看该作者
不错!!!

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发表于 2007-11-26 15:11 | 只看该作者
楼主真厉害,呵呵!支持

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superlish + 5 我很赞同

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changxk0375 该用户已被删除
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发表于 2007-11-30 09:48 | 只看该作者
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zqy610710 该用户已被删除
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发表于 2007-11-30 10:49 | 只看该作者
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zqy610710 该用户已被删除
17#
发表于 2007-11-30 10:57 | 只看该作者
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发表于 2007-12-4 19:32 | 只看该作者
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