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DxDesigner如何出cadence 15.X的网络?

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发表于 2011-8-31 15:33 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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DxDesigner如何出cadence 15.X的网络?DxDesigner画原理图;ALLEGRO画PCB的方法探讨。请高手赐教。在线等候。
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发表于 2011-8-31 21:13 | 只看该作者
我看了cdb流程也有一个export——>allegro但是没有走通,感觉有很多问题!我只用过netlist流程与allegro搭配过,导网表的过程都是一样的,只有建立工程的时候选择不一样,这个直接影响到网表配置文件,也只有这个配置文件不同而已!

dxdesigner_allegro.JPG (55.95 KB, 下载次数: 13)

dxdesigner_allegro.JPG

dx_all_conf.JPG (68.5 KB, 下载次数: 3)

dx_all_conf.JPG

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 楼主| 发表于 2011-9-2 12:04 | 只看该作者
请问元件库应该如何处理?

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发表于 2011-9-2 13:31 | 只看该作者
库, 原理图Mentor的方式,PCB按Allegro的方式

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发表于 2011-9-2 17:29 | 只看该作者
chen123guoyun 发表于 2011-9-2 12:04
3 V1 d5 Z4 }1 e* B请问元件库应该如何处理?
0 F' T# |" S' ?# y
库的话我只说netlist流程,mentor你只用画symbol,不用做cell也不用做part,因为后面两个用不上,allegro只要做package即封装
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