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EDA365电子工程师网»技术社区 › 电子技术社区 › Allegro&Orcad PCB论坛 › 请教各位大虾，这个光耦在走线时应该怎么处理？
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请教各位大虾，这个光耦在走线时应该怎么处理？

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发表于 2011-8-15 19:29 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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3 {: p2 L0 J+ J, \8 k( O9 D  V& J
' k( D* F4 A+ p; h- [; q: u+ n2 Q如上图所示，小弟现在有两个问题：6 k7 h1 x+ L. [; p  Y/ @, b
1，假设pin1 和pin2 参考GND1，pin6是输出pin，参考GND2.  }. _2 A: f$ \$ l$ ]% B
    那么pin4到底是参考GND1，还是参考GND2?0 A: z* B; G7 Q; }9 {
2，由于空间的关系，pin4上面的走线必须走到光耦下面，请问这样做有问题么？
5 @2 S; f; P( e* [  ]: @: f# h9 }, }* L+ x) }8 R/ b/ L
谢谢大家的答复！
* P" e, L- }/ `4 t+ C3 g4 m' V
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nbhand

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发表于 2011-8-16 09:46 | 只看该作者
pin4参考GND2，不然起不到隔离的作用了。。

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dsws

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发表于 2011-8-16 21:49 | 只看该作者
PIN4 参考GND2,且光耦下面不走线，平面层也挖空！

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