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cadence的pcb能不能像protel一样同时看管脚的名字与编号

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发表于 2011-3-7 09:46 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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编号没问题,但是管脚名字怎么看呢?按F5只能看网络名称,那没用啊,不可能人为地把所有网络名称改成管脚名,这也不方便啊。肯定是能看的吧?
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发表于 2011-3-7 09:59 | 只看该作者
allegro本身好像没有这个功能。

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 楼主| 发表于 2011-3-7 10:06 | 只看该作者
啊不会吧,还能不如protel?设计者不能这么不人性吧

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发表于 2011-3-7 10:47 | 只看该作者
管脚名好像不行,编号可以的

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发表于 2011-3-7 10:59 | 只看该作者
个人觉得,protel最强的就是焊盘上可以显示net

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发表于 2011-3-8 16:41 | 只看该作者
习惯就好了。allergo确实没有这点,以前从protel转到allergo也遇到过这个问题。

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发表于 2011-3-9 08:20 | 只看该作者
习惯就好了

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发表于 2011-3-9 08:30 | 只看该作者
我看别的论坛的人讲这个是protel公司的专利技术。

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发表于 2011-3-9 21:14 | 只看该作者
也不清楚,哈哈

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发表于 2011-7-7 08:44 | 只看该作者
这一点PROTEL" }3 ~0 j+ q* m8 ?- P! O$ N
确实很方便布线和查错

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发表于 2011-7-7 09:20 | 只看该作者
本帖最后由 longzhiming 于 2011-7-8 18:56 编辑
; q2 W+ Y! \8 V) E( ?) f8 l2 h6 d$ @$ w
觉得没什么,因为ALLEGRO都是要导入网表才能布线的,protel不需要网表也可以出板子,可能也是因为它有这个功能, 不过出错的机会还是很多,而ALLEGRO你原理图没错就不会错,所以一般都不需要在PCB上查逻辑是否连接错,, 你一定要分析管脚功能/原理,那还不如看原理图?不是吗? 还是习惯问题.( |" u7 V( y0 c3 V1 [- l
2 {3 S3 o- ]$ L& Q: z( f
) x3 V0 c7 I2 |4 L

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发表于 2011-7-8 08:15 | 只看该作者
感觉不方便,说真的,感觉PROTEL这个比较强,另外原件排列也是个问题;

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发表于 2011-7-8 08:26 | 只看该作者
元器件排列可以用Skill解决,格点也可以~
# F3 s/ [, m& l8 o6 f, JAD的布线器比较垃圾,跑个pin多点的板子容易卡死~
* }% ?! d, a) y3 d: U3 j不过Cadence16.x后界面很多也向AD靠拢~各有优点~
如鱼饮水 冷暖自知

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发表于 2011-7-8 18:00 | 只看该作者
习惯是个问题!呵呵!
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