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敢问各位大侠，小弟近日使用Capture CIS进行原理图设计，完成后输出网表，并想通过Allegro进行PCB设计。但! c( y/ V2 x9 H0 ^! ?( G9 c' Z
Allegro输入网表后，出错，显示如下：
0 Y3 G- u$ r/ O: W0 m, sProblems with device 'MC74LCX125_0_14PIN, TSSOP_IC_MC'. JEDEC_TYPE property '14PIN, TSSOP' is illegal: $ t8 p# O3 ~: L- C* u! p
'Package name has invalid characters or is too long.'.Device 'MC74LCX125_0_14PIN, TSSOP_IC_MC' has % c. M% n5 ~ i5 L/ r* c
library errors. Unable to transfer to Allegro.
v9 m; {3 b+ D. M所以有以下几个问题：2 P- l. {# V; ^9 A( a( \1 q& I
1) 如何解决以上问题，是CAPTURE CIS里定义的封装和 ALLEGRO所提供的封装不符吗？3 C( C: M6 i* Y' C
2）Capture CIS生成的元件库，在Allegro导入网表后会自动将Capture CIS元件库里的元件转换成可以在Allegro里摆
( C/ ?: v( T9 R b! Q7 |- W0 h放的元件吗？, c- r/ e, G0 z: [& ~' ^6 }6 G
3）Allegro里提供的“Part developer”工具也会生成原理图里元件封装，与Capture CIS生成的元件库有什么关系？" p1 v4 \1 w. y& R0 ?
4）Allegro里提供的“Part developer”生成的库是否能用到Capture CIS的设计中？
- \: m4 V7 C# Q8 i5）Capture CIS里摆放库里的元件有两种方法：“Place Database Part”，快捷键“Z”与“Part。。。。”，快捷键
1 P$ }" H( I1 u' _2 D“P”有什么联系和区别呢：7 E* F4 N# s) j' O" J$ }- n
烦请大哥大姐帮我解决此问题，感激不尽。 |
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发表于 2008-4-17 16:11
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发表于 2008-4-17 17:13