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发表于 2009-6-11 17:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1.allegro中pcb画完后能不能像PADS一样,有个DRC和连接性检查的统计啊?
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发表于 2009-6-12 11:12 | 只看该作者
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发表于 2009-6-12 14:00 | 只看该作者
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$ j% J0 F8 G6 g" w/ @; yymf2529 发表于 2009-6-12 11:12
( F5 w6 ]  y" H9 V: i' `
这样不直观,这个命令:Setup-Drawing Options,如下图:  ?  R. J& x4 P4 m

8 w4 |3 G+ s/ k' c% X第一行是器件的摆放4 q; U1 v0 I7 K# f- O6 \
第二行是连接性  P) H+ q1 U# w( j
第三行孤立的shape
6 s# P2 K$ z/ M+ j. w第四行没分配net的shape, n5 Z: p% b' ?# Y" ^6 a4 v
第五行是1/21意思是,21块铜,1块没网络.  o+ r7 a+ f* R3 M2 a3 w
第6行是DRC错误个数
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