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发表于 2009-6-11 17:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1.allegro中pcb画完后能不能像PADS一样,有个DRC和连接性检查的统计啊?
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发表于 2009-6-12 11:12 | 只看该作者
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发表于 2009-6-12 14:00 | 只看该作者
Tools > Reports...1 k3 S5 B* w) g7 ]
ymf2529 发表于 2009-6-12 11:12
' c/ u5 w* K" N4 u! z3 G) ?
这样不直观,这个命令:Setup-Drawing Options,如下图:1 O. H! h' v9 k( K, _4 Q

; C7 M) d1 a7 B9 m* S' Y2 }第一行是器件的摆放
4 |. |4 w) D' D: h7 U( f6 d( e第二行是连接性0 T+ P* _* `2 X" p1 P: n4 x
第三行孤立的shape9 G1 a5 D5 w" E! T7 D
第四行没分配net的shape
" p' J4 I- p, c% f$ Y9 Z第五行是1/21意思是,21块铜,1块没网络.- h- B7 E3 @# r: Z5 A
第6行是DRC错误个数
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