请帮忙分析一下DDRx-Wizard仿真DDR3的结果

zsuhh · 发表于 2016-4-19 02:26

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本帖最后由 zsuhh 于 2016-4-19 02:53 编辑

硬件结构很简单,就是用一颗xilinx的FPGA XC7A15T-1FTG256C,加micro的一颗DDR3: MT41J128M16JT-125:K
DDRx-Wizard出现一个提示如下图:

最后结果在DDR_report_Jedec_measurements_Typ.xls文件中有两项fail了, 不知道该如何处理?其他的都pass了,我也附上所有分析结果文件的压缩包. 请大家
帮忙分析一下,非常感谢!

DDR_Results_Apr-18-2016_10h-40m.part01.rar (9.54 MB, 下载次数: 13)

DDR_Results_Apr-18-2016_10h-40m.part02.rar (9.54 MB, 下载次数: 4)

DDR_Results_Apr-18-2016_10h-40m.part03.rar (9.54 MB, 下载次数: 4)

DDR_Results_Apr-18-2016_10h-40m.part04.rar (5.63 MB, 下载次数: 4)

我不知道该如何设置不要威望下载,如果有可能的话,请版主取消一下要威望下载. 非常感谢!

zsuhh · 发表于 2016-4-19 15:06

自己顶一下!

prince_yu · 发表于 2016-7-29 16:40

建议你用一下9.3版本的Hyperlynx，这里面的HTML报告比这个好认，可以很快确定fail项，最近正在做这一块，如果你还在做的话可以交流一下

color_ · 发表于 2016-9-6 17:04

貌似得到的波形是pin上的波形，不是die上的波形。也没有相关设置可以输出die上波形。头大。

hpuyuxuan · 发表于 2016-9-14 11:31

书上的东西讲的不太详细

wxwxw · 发表于 2016-10-8 13:57

color_ 发表于 2016-9-6 17:04; M6 z, T" J- W4 ~8 d# c
貌似得到的波形是pin上的波形，不是die上的波形。也没有相关设置可以输出die上波形。头大。

如果是用的ibis模型，可以改文件，把仿真位置放在die 上
SI/Timing_location keywords to change the location of theprobes:

|************************************************************************
|
[Component]    Dummy
|
Si_location Die          | Optional subparameters to give measurement
Timing_location Die    | location positions
|

color_ · 发表于 2016-10-9 15:18

wxwxw 发表于 2016-10-8 13:57; L& r6 t. h3 p4 u+ p1 w7 @6 R- Y
如果是用的ibis模型，可以改文件，把仿真位置放在die 上
7 B% E/ ~# K) C/ W' k7 Z8 u, o7 w% o1 cSI/Timing_location keywords to change the lo ...

谢谢。马上去试一下看看

zoe17 · 发表于 2016-10-9 19:40

按楼主讲的修改，报错如下 Error : syntax error, unexpected NewLineToken不知道怎么解决呢

zoe17 · 发表于 2016-10-9 19:43

可以了要直接放在component下才行。。

color_ · 发表于 2016-10-17 16:41

wxwxw 发表于 2016-10-8 13:57 Q9 k4 Q1 l+ _, ]; d! M* l3 W
如果是用的ibis模型，可以改文件，把仿真位置放在die 上9 S$ c9 [; o. z6 j
SI/Timing_location keywords to change the lo ...

根据楼主描述，修改了ibis模型，但使用ddrx向导最终生成的结果还是pin上的波形，和我测得的die上的波形还是不一致，是否我修改错了，请帮忙指导一下。谢谢。

wxwxw · 发表于 2016-10-19 05:53

我觉得文件改的没有错误。我就是这么改的。不是很确切是为什么不对。确定component的名字是你仿真里面的component名字吗？

color_ · 发表于 2016-10-19 10:05

wxwxw 发表于 2016-10-19 05:53
! W. P. R1 S% f我觉得文件改的没有错误。我就是这么改的。不是很确切是为什么不对。确定component的名字是你仿真里面的com ...

是的，但输出的结果和我单个网络输出的pin上波形一致。与die上波形不一致。

meng110928 · 发表于 2018-5-4 14:28

大佬你的ilink开发DEMO能不能分享一下，PCB这一块。

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