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通过原理图改变ALLEGRO的线宽

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发表于 2010-8-14 18:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 毒女 于 2010-8-14 18:27 编辑
% U' E! d: F" O, @# s- r8 V
" G: i& d0 O# V: J" I# W; d  u感觉ALLEGRO 设计电源线宽太麻烦了,于是斗胆的先从网络表开刀,没想到试出了2种办法可行6 v/ O, w6 v- {; i
以下是我的操作文件,欢迎大家拍砖吧,丢臭鸡蛋吧, F9 D! }3 Q' ?1 n/ u2 t, E
+ A5 P- ^+ |0 Z' y7 z& w9 k
; X' Y+ j, X9 I2 D( F* s3 k
通过原理图改变ALLEGRO的线宽.pdf (71.06 KB, 下载次数: 1830)
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发表于 2014-3-20 23:10 | 只看该作者
本帖最后由 ☆承诺☆ 于 2014-3-20 23:11 编辑
2 A! W. I; o" M. R' C- k4 q
4 h( }1 J* |* m* E我认为不麻烦,allegro16.6可以显示网络,只要设个最小线宽,就是能过BGA的线宽,或者设好区域规则,把规则里最大的线宽设大一点,60MIL足够,当你知道那条电源线能流过多少电流时,画的时候就画多大的线宽,要是还不够,就用铜皮来加大,特殊的有阻抗的要求的线,就把那几根线的网络规则设下就行了,鸡蛋扔来吧

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发表于 2014-3-19 11:37 | 只看该作者
無言.... , 這哪算新發現啊 , Capture 10版就有的功能啊 , 條件是你不能用 other 方式來轉出 netlist ,  必須用 PCB editor 介面轉出3個 dat 檔的格式才行.
, ~9 V) m7 |* B. n, N) P" t- d而且這是 constraint ,  如果是re-net in , 那已拉好的線也不會變更線寬 , 頂多是出 DRC

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发表于 2014-3-20 10:37 | 只看该作者
个人愚见 其实最好不要在原理图里做过多约束性的规则添加  容易跟.brd文件带来其他 约束添加问题.

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发表于 2010-8-14 18:31 | 只看该作者
看看,呵呵

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发表于 2010-8-14 19:59 | 只看该作者
其实在PCB里设也不麻烦嘛。你的方法在PCB里还能改吗?

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同感  发表于 2011-12-5 21:08

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发表于 2010-8-14 22:48 | 只看该作者
对于原创一定要顶。

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发表于 2010-8-14 23:40 | 只看该作者
好!!好!!好!!好!!好!!好!!!!

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发表于 2010-8-16 08:37 | 只看该作者
学习下!!

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发表于 2010-8-16 08:51 | 只看该作者
哦,还可以这样子

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发表于 2010-8-16 09:27 | 只看该作者
专研精神可嘉

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发表于 2010-8-16 11:40 | 只看该作者
看看

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发表于 2010-8-16 13:53 | 只看该作者
这个方法很新奇呢,先看看哦。

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发表于 2010-8-16 18:34 | 只看该作者
这个要看看

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发表于 2010-8-16 19:24 | 只看该作者
路过看看

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发表于 2010-8-17 10:33 | 只看该作者
谢谢分享

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发表于 2010-8-17 13:35 | 只看该作者
hehe呵呵

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发表于 2010-8-17 14:24 | 只看该作者
精神可嘉,但还是建议保持网表的原始性,减少手工对网表的操作。
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