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EDA365电子工程师网»技术社区 › 电子技术社区 › PADS论坛 › PADS logic怎么导出网表，导入到allego画板
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PADS logic怎么导出网表，导入到allego画板

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blyxz

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发表于 2017-7-19 16:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位大大：     求教～～～PADS logic怎么导出网表，像AD里面的protel、telesis网表一样经过转换就能导到allegro下画PCB？？？
2 Z, l' W8 ]- J; I$ `& t8 |# w- x, g, d# k0 ?
+ t! \% ]& Q9 Y3 X
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linxiwell

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发表于 2017-7-19 21:27 | 只看该作者
用EDA_BOMHelper可以读取Logic的原理图然后生成telesis网表。

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blyxz
论坛上的EDA_BOMHelper都被屏蔽了！！？阁下能发我一份么  详情 回复 发表于 2017-7-20 17:26

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 楼主| 发表于 2017-7-20 17:26 | 只看该作者
linxiwell 发表于 2017-7-19 21:27
/ O1 V6 q  e) Z- S! U% O用EDA_BOMHelper可以读取Logic的原理图然后生成telesis网表。
; ?8 v. j8 Q9 E8 n. E/ L8 c9 B4 e
论坛上的EDA_BOMHelper都被屏蔽了！！？阁下能发我一份么

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linxiwell
不是不发而是发了你也用不了。是要注册的。抱歉啊！  详情 回复 发表于 2017-7-20 19:43

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发表于 2017-7-20 19:43 | 只看该作者
blyxz 发表于 2017-7-20 17:26
" Y$ V5 e8 {( f" u% v7 O论坛上的EDA_BOMHelper都被屏蔽了！！？阁下能发我一份么
& S! N# e" P- e: Z- A3 ^3 j
不是不发而是发了你也用不了。是要注册的。抱歉啊！+ i! v% {) z2 u4 i) ?. I

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