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PCB Layout Reference疑问

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发表于 2016-8-25 17:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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英文原话是这样的:
7 R' @+ L% a0 d' L
* f* l% s; e$ ~9 L, B* B7 V8 L$ s( Inote to keep all signal traces in same trace delay and impedance8 O$ D& R# Y2 p4 T) t( M( l1 K
/ w& a$ L: N/ {4 T9 F( e
这句话得怎么理解?是走线时要保持同样的延时和阻抗?3 m- R! _* F( t2 M( O6 h  [
“trace delay”指的是什么?
" E/ I2 ^' o) U
) b: H/ ]2 K) F, K' S
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发表于 2016-8-25 20:20 | 只看该作者
走线时延

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发表于 2016-8-26 08:04 | 只看该作者
等长、阻抗一致。

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发表于 2016-8-26 13:21 | 只看该作者
delay就是延时。意思是,保持一致的走线延时和阻抗。

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 楼主| 发表于 2016-8-29 16:21 | 只看该作者
谢谢
: e; a) i6 @; A  X0 K

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 楼主| 发表于 2016-8-29 16:21 | 只看该作者
谢谢" j1 j& F' V4 W1 Z

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发表于 2016-8-30 14:53 | 只看该作者
实际体现在PCB上就是线宽一致(即保持阻抗一致),走线长度一致(即等长处理保持时延一致)
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