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EDA365电子工程师网»技术社区 › 电子技术社区 › Mentor论坛 › xDX Designer 打包的时候提示如下ERROR,是什么原因呢？
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xDX Designer 打包的时候提示如下ERROR,是什么原因呢？

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忘顰

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发表于 2015-5-11 16:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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xDX Designer 打包的时候提示如下ERROR,是什么原因呢？# }3 }+ X, c: {

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蚂蚁乱舞

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发表于 2015-5-11 17:52 | 只看该作者
专业顶帖的:lol:lol

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xiesonny

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发表于 2015-5-11 20:44 | 只看该作者
我是回复捞分的

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prince_yu

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发表于 2015-5-12 13:46 | 只看该作者
去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的

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菜鸟小泽
请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？  详情 回复 发表于 2015-5-19 22:43
忘顰
确实是库的原因，Pin Name 中不能有空格出现  详情 回复 发表于 2015-5-13 13:52

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忘顰

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 楼主| 发表于 2015-5-13 13:52 | 只看该作者
prince_yu 发表于 2015-5-12 13:461 R1 |+ q" M" @6 V0 l, q1 p
去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的
8 z- U. j2 u. b) S- |0 A% i! z
确实是库的原因，Pin Name 中不能有空格出现
8 \/ v. Q/ S! f6 ], m  ~/ t5 Z; u+ N3 H

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siminliu88

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发表于 2015-5-13 14:27 | 只看该作者
学习了

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菜鸟小泽

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发表于 2015-5-19 22:43 | 只看该作者
prince_yu 发表于 2015-5-12 13:46: {' O2 ^5 P  {' R2 K
去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的
3 f8 o; @, Y" T4 A
请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？
" _1 s% }- r/ q+ ]9 W

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IMG_20150519_093519.jpg

点评

prince_yu
警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约束管理数据库的，所以警告也是正常，因为本身就没有，但这并不代表不能画PCB 如果是Dxdesigner还出现这个  详情 回复 发表于 2015-5-19 22:57

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prince_yu

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发表于 2015-5-19 22:57 | 只看该作者
菜鸟小泽 发表于 2015-5-19 22:43
! T  e+ O1 f$ e8 e( k请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？
7 R2 s/ _& C! {
警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约束管理数据库的，所以警告也是正常，因为本身就没有，但这并不代表不能画PCB5 k' ?! d$ k$ v5 u. s. W3 s
+ O, e3 I8 z7 z1 _! a
如果是Dxdesigner还出现这个错误，那应该是工程文件不完整，建议你新建一个全新的prj，然后用file-open-block的方式打开现在的原理图，一页一页地拷贝过去，在新的工程里打包试试，只要库没问题，这样做肯定也没问题的。, W$ x9 b7 s4 c+ N: w# l5 o/ G( V% x

点评

菜鸟小泽
好的，我尝试一下，谢谢  详情 回复 发表于 2015-5-19 23:02

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菜鸟小泽

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发表于 2015-5-19 23:02 | 只看该作者
prince_yu 发表于 2015-5-19 22:576 D" }  }7 I  O% ?# a/ _5 l; R# ?
警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约 ...
6 l2 n# P- L' J/ }( K; z; [) o3 k
好的，我尝试一下，谢谢% V3 x, l# t: o

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falw985

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发表于 2015-5-20 15:31 | 只看该作者
xuexiyixa

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