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关于AD芯片选型的问题请教

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发表于 2015-3-14 14:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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要设计一块8路AD同步(时间同步、相位同步)采集的板卡,分辨率≥14bit,采样率≥5Msps。AD数字输出进FPGA。AD9252是8路模拟信号进,8路数字信号串行LVDS输出;; b% {. e; r% E7 P8 x
AD9251则是2路模拟信号进,2路数字信号并行输出(D0A-D13A、D0B-D13B)。' z* I) E. U' q0 m( v
理论上选择AD9252,一片即可;
! L' ~, l+ T* H& x+ b9 M' A选择AD9251,需要4片,要额外考虑芯片间同步问题。0 l% a7 k7 T" A* L
想请教下各位,如果串行LVDS输出,在FPGA内串转并时,是不是容易产生不同步的问题?如果并行输出,要多走不少线,芯片间的同步实现难度大不大?
  I$ S. B6 n0 N/ ?初次使用AD芯片,有类似开发经历可否麻烦给个参考电路或其他优选芯片。  E4 m' K! }2 L/ ^$ V1 Y
非常感谢!( W; ~6 F, R; t
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发表于 2015-3-14 23:22 | 只看该作者
本帖最后由 part99 于 2015-3-14 10:32 编辑
5 d; B( r( w' v( Q( r3 |" M, c. G" ~% e4 ]1 E
并行时间同步好做一点,串行的同步在FPGA端有点麻烦。4 t$ ~$ ^( ]: a/ L: C( }) D9 ^4 V
不过,你的采样率不高,可以用9252,但如果PCB有位置,而且FPGA离AD芯片不远,最好还是选择并行。
' Q5 j2 l$ e& W# @如果你担心不同的芯片处理的速度不一样而影响同步,那么同一个芯片不同通道处理速度也有可能不一样,所以9252和9251是一样的。9 i4 r9 N% V# m/ |
不要在找其他的AD转换芯片了,analog device 已经是业界最好的了。

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回答得很详细,非常感谢! 我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片间同步,如何保证4片AD9251收到的SYNC信号严格同步? 是利用FPGA的全局时钟直接输出4路SYNC信号,还是使用独  详情 回复 发表于 2015-3-15 23:14

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发表于 2015-3-14 23:26 | 只看该作者
如果用9251, 建议9251输入的时钟由FPGA打进来,而FPGA的采样时钟由9251的输出时钟来提供。

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发表于 2015-3-15 21:32 | 只看该作者
以前用过4个双路并行的AD7760,芯片有个同步管教,同步比较好做  9251没用过

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谢谢啦!AD9251也有个同步管脚  详情 回复 发表于 2015-3-15 22:58

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 楼主| 发表于 2015-3-15 22:58 | 只看该作者
戏出东方 发表于 2015-3-15 21:32
, [1 @9 Q0 [& Y* k3 G以前用过4个双路并行的AD7760,芯片有个同步管教,同步比较好做  9251没用过

" o0 r- f4 q  @+ a, w) p+ ^; d% f谢谢啦!AD9251也有个同步管脚1 t( e) }7 d; n' g4 h

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 楼主| 发表于 2015-3-15 23:14 | 只看该作者
part99 发表于 2015-3-14 23:22
/ H, z: Y3 Z4 R并行时间同步好做一点,串行的同步在FPGA端有点麻烦。/ z; z* J# [1 U% M
不过,你的采样率不高,可以用9252,但如果PCB有位 ...

# M4 @% \# j; W: N, w6 h9 {回答得很详细,非常感谢!. \1 S# K8 x. N- {3 f
我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片间同步,如何保证4片AD9251收到的SYNC信号严格同步?
3 c2 M3 T1 V9 t$ c( X0 n是利用FPGA的全局时钟直接输出4路SYNC信号,还是使用独立的时钟驱动芯片分路输出SYNC?如果使用FPGA全局时钟直接输出4路的话,假如20Msps的采样率,SYNC的PCB布线走等长,FPGA内部延时问题不大吧?
, P, Q* \: X# F& P& p7 @4 G

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我也建议用FPGA出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可以忽略不计,但为了信号完整性,一定要走菊花链,或者加个同步的buffer。  详情 回复 发表于 2015-3-16 05:56

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发表于 2015-3-16 05:56 | 只看该作者
本帖最后由 part99 于 2015-3-15 16:58 编辑
9 W9 c! F- P; B1 A% O% a
zzzljb 发表于 2015-3-15 10:146 g- O: b' M) e# o- U) H- t
回答得很详细,非常感谢!2 p/ d3 l: y' S# Y  Q
我犹豫要不要使用多片是考虑片间同步信号的处理。AD9251有个SYNC管脚可用于片 ...
9 `- g, R! u* l/ d- `0 j7 p
我建议用FPGA全局时钟出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可以忽略不计,但为了信号完整性,一定要走菊花链,或者加个同步的buffer。
% J% v8 @( Q0 `0 N" l( F3 w( w4 m

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非常感谢!  详情 回复 发表于 2015-3-16 10:17

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 楼主| 发表于 2015-3-16 10:17 | 只看该作者
part99 发表于 2015-3-16 05:56
7 q; M6 g$ X; d7 t' d5 a* f我建议用FPGA全局时钟出同步,20MHz时钟对现在的高速信号来说可以忽略不计,不要担心信号线延时,根本可 ...

8 M) W; ?- }) }4 F非常感谢!
( T. d9 ~$ @) i6 P* ~7 G

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发表于 2015-3-16 14:05 | 只看该作者
高大上的东东,赞一个。

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fallen兄又取笑我了,这种东西对你而言还算高大上啊 话说之前没留意fallen兄EDA365版主的头衔啊,新晋升的?  详情 回复 发表于 2015-3-18 22:18

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 楼主| 发表于 2015-3-18 22:18 | 只看该作者
fallen 发表于 2015-3-16 14:05
% v2 d: X- x. E/ _. p高大上的东东,赞一个。
2 |+ |9 \* D4 S/ C. v
fallen兄又取笑我了,这种东西对你而言还算高大上啊
1 i; n1 C/ w, ?9 A4 _话说之前没留意fallen兄EDA365版主的头衔啊,新晋升的?+ B+ C$ i1 ^$ T

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为人民服务的。  详情 回复 发表于 2015-3-18 23:16

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zzzljb 发表于 2015-3-18 22:18' {! Q# v- W) [- g9 P$ Q
fallen兄又取笑我了,这种东西对你而言还算高大上啊" S7 M; a  \6 r1 d% o( i
话说之前没留意fallen兄EDA365版主的头衔啊,新晋 ...
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为人民服务的。

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