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一个主原理图中包括2个子原理图(room),很多网络无法导入?

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发表于 2014-12-29 15:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位坛友:
6 n* W. ]* F7 l, o! v& h2 V* A       不好意思,又来打扰了!现在碰到一个问题:一个项目中包括3张原理图,其中一张是主原理图,下面有2个不同的子原理图,但导入PCB中,很多元件的管脚无法导入网络,或者导入的网络分大小写(同一个元件中不同管脚有些为大写有些为小写),而且每次从原理图更新到PCB时软件都提示需要更新网络,请问各位这是为什么呢?有什么解决方法?% n9 V! Y2 y: i1 I5 ~2 K
      附件为案例,由于涉及公司的设计,故只能简单画部分原理图示意一下,忘各位谅解!谢谢!
5 {4 P3 ]! E, Q! J, }

PCB.rar

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 楼主| 发表于 2014-12-31 10:41 | 只看该作者
还是找不到解决方法,每次原理图更新到PCB中都需要手动修改网络,奔溃了

点评

我也想知道,我试了好多次都是和你的一样的。但我重新换一个一样的原理图元件又OK了。  详情 回复 发表于 2015-6-19 09:54

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发表于 2014-12-31 14:03 | 只看该作者
网络标号重复???

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发表于 2015-6-19 09:54 | 只看该作者
老水牛 发表于 2014-12-31 10:417 ?& M. g4 o4 T. A
还是找不到解决方法,每次原理图更新到PCB中都需要手动修改网络,奔溃了
! Z! S( u8 z- c# j$ \, e, d( d( c
我也想知道,我试了好多次都是和你的一样的。但我重新换一个一样的原理图元件又OK了。8 I4 c# r. P" ]. B: ]! _

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发表于 2015-6-19 12:22 | 只看该作者
目测  应该是封装没匹配好 或者 原理图没有加offset
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