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AD10中怎么进行DDR2的差分时钟信号的等长处理？

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wawe

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发表于 2014-11-4 18:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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两颗DDR800用T型拓扑，想知道怎么走线使时钟差分信号对自身等长，而且从CPU处理后到两片DDR的时钟网络也是等长的？如下图即A+B=A+C的长度。研究了2天还是不知道怎么能弄，地址线倒好办，差分信号因为还有阻抗问题，线间距已固定，不知道要怎么来实现了，求高手指点，不胜感激~+ w% f- V: P' E/ C' E6 |7 i( z

  G0 O$ t4 D1 t- ?9 X
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发表于 2014-11-4 19:43 | 只看该作者
本帖最后由 goolge 于 2014-11-4 19:45 编辑 ' f2 {% t% S# ]2 [  G4 V5 J* ~

& [5 w, P: E3 `0 J+ o9 T$ K2 {" O T型结构的等长，还是PADS9.5或Cadence好弄，AD估计都没这功能。

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liyumingyh

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发表于 2014-11-24 16:56 来自手机 | 只看该作者
Ad还真有这个功能

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icm

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发表于 2014-11-25 10:05 | 只看该作者
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