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楼主: 路人丙
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请教时钟线上高频滤波电容和电阻的选择

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 楼主| 发表于 2008-7-25 10:27 | 只看该作者

4层PCB,1.TOP;2.VCC;3.GND;4.BOT

4层PCB,1.TOP;2.VCC;3.GND;4.BOT& m6 z. R' `2 t- v
7 n: U/ X$ m/ c" [
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 楼主| 发表于 2008-7-25 10:40 | 只看该作者

非常感谢各位的回帖!!!!

***正如楼主所说应该是千兆时钟线(125M)引起的.如果是25M导致,那么它的三阶和五阶应该都会有很明显的尖峰,但是没有.www.eda365.com) T* Z/ k: n8 [! ^2 _- g
: w5 O: b. _, k很遗憾的是: 千兆以太网的所有数据线都是点到点的连接,中间没有串阻.不然比较容易分析出.% B0 W" S0 Q) B( ?
不明白的是楼主为什么要那么绕线,CPU和PHY的距离这么近根本没有必要这么做.7 s" P5 Y% h! D; `- g# Z0 G( {$ V
时钟线和其它线的间距太近,根本没把它当时钟线来处理., b/ y. c; T6 z. P
. I( n) ^; ~: K6 j) @楼主把千兆以太网的所有线布在同一层,这点比较好,但是不知道这些线的参考平面怎么样?***. C& l2 I. S# Q2 }9 b
非常感谢楼上的回帖!!
; m) C* a7 {: }. v1.我们测试的10M,100M,1000M的都有问题,还都是一样的,就是125M的倍数。
/ L1 n  G) B9 B7 C6 W5 f! ^* |2.千兆以太网的所有数据线都是点到点的连接,中间没有串阻.不然比较容易分析出,不知道比较容易分析出什么?CPU和PHY的距离比较远的。0 }0 d' E- I: |' Z" S
3.上面提到的加时钟BUFFER的效果是不是一定比没有加的好呢?
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发表于 2008-7-25 12:23 | 只看该作者
上面提到的加时钟BUFFER的效果是不是一定比没有加的好呢?这个不一定,如果是1驱动2就可以不用。
% `: L/ X7 N/ Z( Z; l: P
$ J( Q# x$ K4 R$ r% p# o125M出问题,但是125M是25M的3倍频,为什么不考虑25M出了问题,就是时钟那块出问题了,我在你的帖子里写的很清楚。

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发表于 2008-7-25 13:25 | 只看该作者
楼主要用四层板完成这样的板子,而且还要保证EMC,真的是难能可贵.我自愧还没到这样的火候.
3 D1 `4 x$ @9 C& N9 L/ z强烈期待楼主改板并通过EMI测试的板子
- ^! R# F; C$ G4 _$ i- q8 U.通过后希望楼主能拿出来分享,一起学习.

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发表于 2008-9-24 10:33 | 只看该作者
建议增加EMI 相关器件 包括磁珠 压敏电阻等

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发表于 2008-10-23 17:11 | 只看该作者

学习学习!

谢谢大家!

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发表于 2008-10-26 08:44 | 只看该作者
同意liqiangln的说法,应该是25M出的问题。
; l9 ]4 t& }% F从NG的频点来分析,25M肯定是出问题了(225M over 0.7)。至于125M有没有出问题,不好判断。2 m! Q% o* V# Y* h# \1 B1 G
25M的3、5倍频没出现,原因是他没有借助某一“天线”辐射出去而已。( k, _" j% Q- Q7 A8 ?& P
在25M时钟上串磁珠,(时钟信号会恶化,前提是恶化的成度在时钟信号承受的范围内): l( D0 r! d0 K3 |- H* t
另:看不到你的机构件,进构件的不合理布局,会引起”天线“的产生。
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