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楼主: ccddll
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有人能解释下这个图吗

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发表于 2008-8-14 16:45 | 只看该作者
原帖由 Allen 于 2008-7-10 20:55 发表 ! o7 M* g1 L) z3 K3 l5 F" @

7 r" |2 E) O, j* ~" T2 s( J作者不是牛得不行就是菜得不行
/ U. Y- X8 m$ k& b

8 H7 v0 S# _; m" N, @# r0 M8 x应该是菜的不行。

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发表于 2008-8-21 17:08 | 只看该作者
举双手赞同!!

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发表于 2008-8-21 18:38 | 只看该作者
说不定是焊接测试勾什么的 连地

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发表于 2008-9-5 15:49 | 只看该作者
最初以为是top 层有IC , 认为是IC 内部定义独立的ground pin相互连接,再单点和GND相连,后看到内层有一对diff trace,认为是在两侧加的GND via。至于将via穿起来,像是恶搞,没有意义

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发表于 2008-10-30 17:59 | 只看该作者

.

有点像改板,上一板电容的fanout...改板删了电容没有删去走线和孔的

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EDA365特邀版主

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发表于 2008-10-31 09:18 | 只看该作者
原帖由 ccddll 于 2008-7-11 16:27 发表
2 p: R1 t+ W1 h2 r. l2 \* j这是人freescale的一个开发板图嘛0 M# i0 q/ A8 b4 W2 j' C
不会这么无聊在上面涂鸦吧

' ?% j9 A' p: ~+ ~! l- l  G7 {. U; h5 }& S
不要觉得fresscale就如何如何,上次见到几个cypress的板子,USB走线相当不规范,和他们的layout guide就严重不符。9 O) T& s6 \/ x  m8 \7 R+ V
其实想想,大公司分工是很明确的,制定guide和layout应该不是同个人了,比较烂的demo板出现也是正常。
sagarmatha

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发表于 2008-10-31 15:42 | 只看该作者
原帖由 forevercgh 于 2008-10-31 09:18 发表 ! E, N$ h$ N3 n9 W1 J
* R% s7 [& I5 I2 j# z5 i7 ~) l) u
7 I- {% S" z6 q( T- y! N
不要觉得fresscale就如何如何,上次见到几个cypress的板子,USB走线相当不规范,和他们的layout guide就严重不符。1 v( |! S: o8 _0 A" [
其实想想,大公司分工是很明确的,制定guide和layout应该不是同个人了,比较烂的demo板出现也 ...

3 a2 ^$ l- i1 [有同感 Demo 板子就是有不规范的地方,只要他们的FAE没发现 呵呵
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