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一组16路的lvds总线，频率为96m，在放置收端100欧电阻有什么要求呢？

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bluefoxde

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发表于 2008-5-8 16:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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一组16路的lvds总线，频率为96m，在放置收端100欧电阻有什么要求呢？
( h: y" s  E* P' j. C% ^具体问题描述如下：
/ ~9 s& j) w4 B$ L我在检查pcb时发现，100欧的电阻到收端的距离差别较大（最大1cm），但是由于FPGA的正面无法放置，只能在背面。3 G2 w& F0 P( F0 i1 {* [4 X9 o
而背面首先是滤波电容。LVDS总线收端电阻只能放置在FPGA的边上，这样导致了电阻到收端的距离差别较大，高手请
! t# l% @. @2 w1 d发表看看，该布局是否有问题，多谢！！！
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pcb007

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发表于 2008-5-8 21:29 | 只看该作者
1CM约400mil，感觉问题不大，但要注意：- n1 c7 P' \' F
（1）LVDS要先经过电阻再到接收端；* L. m" u% H  H5 \- d& l
（2）LVDS的2根线要等长。

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liqiangln

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发表于 2008-5-9 17:29 | 只看该作者

!

100欧的电阻到收端的距离差别较大（最大1cm），
2 {2 L* f" z4 h4 W! n就是接收pin到电阻的距离，最大的距离是1CM，建议pin到电阻的距离等长，总差分线也等长。

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bluefoxde

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 楼主| 发表于 2008-5-15 16:47 | 只看该作者

多谢大家的建议，在layout时我会注意的。

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