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关于等长线的问题

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发表于 2009-3-9 14:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我的板子有64根数据线
- e& z$ G5 I$ d  Z0 x在top层不能完全布通 需要把其中一部分布到内层
6 s. B+ k5 H) t. N: `" ^" D+ }这样走内层的线每根至少要两个过孔- R; S3 F- Y$ x
请问这样布等长线的话过孔的长度可以忽略不计吗' X+ ~6 u: F/ R9 e# b* ~1 U4 ]( ]
而且内层的信号速度和top层的信号速度不一样: ~# X# k2 j' O1 B* c+ r
那么改如何做到数据线等长呢
5 O( a5 i, @. w: a0 K1 G( X# v: k$ e/ B! o
请各位帮个忙指导一下
- i$ C( c# x- p' d+ D% F谢谢了
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林嘉欣,我稀罕你!!

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发表于 2009-3-9 15:10 | 只看该作者
而且内层的信号速度和top层的信号速度不一样
% S0 k/ D3 S4 p那么改如何做到数据线等长呢- C; _) W4 g" B8 L
————————————————————————
( U1 r+ G" x: c这点我也想知道。6 _) J0 w8 A& k
, H# ?: V# i/ u/ k1 p
另外,100Mhz的SDRAM的布线要求应该不是太苛刻吧,只要使SDRAM尽量靠近CPU,时钟线尽量短,布线随便布就可以。跑起来就没问题。(SDRAM是100MHz的情况。)
7 ?  s" r" F1 V: R过孔应该可以不可虑。但是如果考虑的话,应该如何计算?
  Y) m7 B) b7 S$ o% D. i: n同问。

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 楼主| 发表于 2009-3-9 17:20 | 只看该作者
高手来指导下呀
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发表于 2009-4-12 09:07 | 只看该作者
过孔对上升时间的影响,差不多也就十几二十皮秒,对于这个速度的可以不考虑了。对阻抗倒是影响大些

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发表于 2009-4-15 17:42 | 只看该作者
???????

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发表于 2009-4-26 01:14 | 只看该作者
一般情况下,一个过孔等于2~3MM的长度。SDRAM,DDRI,LAYOUT时可以不考虑。
4 P( @' S% G* y但DDRII,DDRIII需要考虑。
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