DDR仿真网络选择

dhgchina · 发表于 2018-1-11 17:30

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使用DDR仿真的时候，选择数据网络的时候为何DQ/DM分一起，见图中箭头处。是哪里出错了，如何改正？求教

superlish · 发表于 2018-1-13 10:32

前面网络那一步没有问题吗？

GHOST · 发表于 2018-1-13 14:58

参考差分的形式，你的模型是不是有问题？定义了差分？

dhgchina · 发表于 2018-1-15 10:26

superlish 发表于 2018-1-13 10:32# U8 w) K+ j1 G- S& J+ L3 [
前面网络那一步没有问题吗？

没有问题，就是软件自动定义仿真网络的时候就把四根信号两两分一起了，不知道是什么原因。

dhgchina · 发表于 2018-1-15 10:29

GHOST 发表于 2018-1-13 14:58
5 @, N# a" a _, V( }3 J参考差分的形式，你的模型是不是有问题？定义了差分？

有这种可能，我也怀疑是模型带来的问题，CPU厂家给的模型，DDR3自己网上下载的，我换了三个DDR3发现没变化，应该是CPU模型带来的问题，这种情况怎么解决啊？模型里怎么查看？

GHOST · 发表于 2018-1-15 11:53

dhgchina 发表于 2018-1-15 10:29
1 u/ L. s1 I' g: _& {3 G3 Y& o" W有这种可能，我也怀疑是模型带来的问题，CPU厂家给的模型，DDR3自己网上下载的，我换了三个DDR3发现没变 ...

直接打开就可以看啊

dhgchina · 发表于 2018-1-15 17:13

GHOST 发表于 2018-1-15 11:53; `# p% ^; }" o2 `3 y
直接打开就可以看啊

打开看没问题啊，有什么解决办法没有？

dhgchina · 发表于 2018-1-15 20:27

GHOST 发表于 2018-1-15 11:53
3 {: P" L9 t0 ~5 J. ?& [: e& l) c: r直接打开就可以看啊

问题解决了，确实是模型的问题，DDR3模型里面定义的差分管脚没对应，换一个模型解决了

深圳—allegro · 发表于 2018-3-12 20:10

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306871268 · 发表于 2018-4-29 00:31

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[HyperLynx] DDR仿真网络选择