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楼主: EDA365QA

2017年11月28日QA检查报告节选

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qilinwang66

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发表于 2017-12-1 09:29 | 只看该作者

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发表于 2017-12-5 19:12 | 只看该作者

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wrh

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发表于 2017-12-22 17:44 | 只看该作者

bingshuihuo 发表于 2017-11-29 13:55
3 l/ ~& O0 h4 z6 q7 d+ U' d上拉位置应该怎么摆放？

DDR3 以上，地址线走菊花链，上拉从最后一片ddr拉

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