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2017年11月25日QA检查报告节选

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发表于 2017-11-27 11:37 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.所有层完全隔开7 P# v- a" D& i6 a

% H1 F" g9 R, j7 P, I/ F0 w
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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
2.保护地是否接到孔上
* M0 ^' S1 ^. Q+ `0 p; X
- D0 {% z9 z& g; M* v' m

点评

我现在做的产品电路板固定支架都是金属的,我都不把GND连到过孔上的。连不连有什么好处和坏处吗?  详情 回复 发表于 2017-11-29 11:21

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
3.视频模拟线包地处理" O# ?: d/ Y& e  R3 b

1 v7 S) p; h' {" Y

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
4.跨分割了2 H0 q( \: ~4 q& W
2 R$ r+ h9 q( B( c

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
5.电源PIN没加粗
" w) L4 D: j- ^ 6 c% y' k* s$ A# j4 \8 g  [1 P. c

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
6.没有按照差分线处理
" [$ G2 B; |  J: y* }8 i, C2 x6 ]
" F9 z& n1 ~$ X

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
7.DDR的差分走线需要优化处理) K/ ^9 ?/ K$ y; i1 p
' M% ]2 H( L3 p' s; G

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
8.二极管封装与原理图不一致
" i. L6 p$ r8 [4 K2 W 2 \8 V8 f+ X8 J. M4 a+ J

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
9.光耦前后做隔离
0 L+ A9 X0 c0 j + z- Q9 N1 X0 b" K

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
10.VCC通道小了
9 D8 ?) l  |  y& U8 z/ R
+ c, d. E9 u) \: {

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 楼主| 发表于 2017-11-27 11:40 | 只看该作者
11.电源几个点不要铺一个平面
8 F' h7 y& V6 y. l% W
8 C$ g8 P$ _2 ]. O

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发表于 2017-11-29 11:19 | 只看该作者
这个是什么器件啊,需要所有层全部隔开?

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发表于 2017-11-29 11:21 | 只看该作者
EDA365QA 发表于 2017-11-27 11:38
  `& D/ e1 z/ ^, \* {- L" K1 s" {2.保护地是否接到孔上

) F9 V, c+ i# Z4 m0 [  h* e% d我现在做的产品电路板固定支架都是金属的,我都不把GND连到过孔上的。连不连有什么好处和坏处吗?

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发表于 2017-12-1 09:40 | 只看该作者
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