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verilog编码规范,该文章主要从8个方面,来阐述对verilog的编码规范的要求。并且每一条规范都有相应的等级。 这8个方面主要是:
; {, w' E7 |! }9 r. ^/ Z 1,命名规范;9 q# j6 L+ E( J A
2,文件头规范;' v! x+ O* L, b9 B7 S
3,注释规范;
! A3 c4 i3 |: H* P( ~ 4,编码风格;/ N7 ^% D2 w8 L/ m
5,DFT要求;
" [2 Q w2 T8 Y0 I5 d$ v 6,仿真要求;
9 E3 {2 Q: w& L9 T/ \4 [& f 7,STA要求;( k1 r8 i7 S% n) \/ A. ]& O8 ?
8,综合要求;
9 }- {( m# v( j% c2 O6 q2 ~ 好的编码规范不仅能增加代码的整洁、可读性;更能够减少bug产生的可能性,以及对后期DFT,STA和综合都产生良好的影响。
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