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锁存器问题

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    组图打开中,请稍候......
发布时间: 2013-6-7 20:25

正文摘要:

1、设计电路图如图所示;PC4以及PC6-9均为I/O口; - g% F1 A  U) v7 I% b5 R2、测试中采用以下两种方式,Q0~Q4均输出4.5V;# G. Q/ [  |# }& \+ S     PC4(I/O)输出高电平选通锁 ...

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yuanle1013 发表于 2013-6-9 08:23
wangshilei 发表于 2013-6-8 11:03
; ~% r& }/ C) _$ v+ m1 h你输出有上拉也下拉是什么意思
4 e! s& w+ p4 s
下拉电阻是预留调试用的,跟那个问题没多大关系吧
wangshilei 发表于 2013-6-8 11:03
你输出有上拉也下拉是什么意思
yuanle1013 发表于 2013-6-8 10:54
有没有人晓得捏
yuanle1013 发表于 2013-6-7 20:26
更正一下,是Q0~Q3这四个引脚输出为4.5V。Q4都没接{:soso_e113:}
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