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电巢直播8月计划

altium上看到的一个现象,请教下!

查看数: 945 | 评论数: 5 | 收藏 0
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    组图打开中,请稍候......
发布时间: 2013-2-17 15:44

正文摘要:

7 P4 e7 ~8 W& i' Z  j3 e# T , {8 {; k$ r2 `5 @5 d# s6 u3 K上图的那段网格如何实现!

回复

cdmsz 发表于 2013-2-19 22:54
y这样做的目的是什么?
花心刺猬 发表于 2013-2-19 17:42
谢谢!
PCL 发表于 2013-2-19 11:39
本帖最后由 PCL 于 2013-2-19 11:41 编辑 1 g1 o9 }3 W: H% v: P% o

, u; }2 m6 ?+ m4 K+ R采用了AD的add subnet jumpers 功能,在FPGA调管脚的时候比较常用到。8 \/ Q8 Q7 _4 Z- ~

' {( G- K- T2 O6 _. J. x
' g" J) }; {7 @7 f填写需要自动连接的长度,效果图。

点评

pcl果真是高手  发表于 2013-2-19 22:59

评分

参与人数 3贡献 +30 收起 理由
wanghanq + 10 图片中未看到 eda365 标识 赞
花心刺猬 + 10
77991338 + 10 很给力!

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77991338 发表于 2013-2-19 09:20
AD里面到还真没见过这样的走线...不过在Mentor里面的半锁定线段差不多是这样的....
hantown 发表于 2013-2-19 08:59
路过,没见过这种情况!
' B* q, r; I5 e# ^" F8 X# J等待高手解答!
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