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求救verify design 显示电源和地没有连接上?

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发布时间: 2011-1-18 11:33

正文摘要:

本帖最后由 longfeisky 于 2011-1-18 11:33 编辑 4 M- {$ I, _9 R6 m& t! G3 B6 W; w+ ?) i, \5 s" K; b4 E7 [8 V 我用的是电源和地平面,split/mix 4 i" E/ U0 Y7 V也灌铜了,看上去也连接啦3 O  ? ...

回复

dengzs2008 发表于 2015-9-2 17:09
中间层为混合平面层,我也遇到过类似的问题,不知道为何报错,见链接:https://www.eda365.com/forum.php? ... mp;extra=#pid946206
longfeisky 发表于 2011-1-19 10:54
单独检查连接的的时候) l0 c' Q) U4 E% @9 B# Q% o& X. t; u
把 Ignore CAM plane connection for isllated stitchin vias 选上) S# c* C+ u5 `# ~9 ~9 L: T7 B0 Q
就没有问题了
song87016 发表于 2011-1-19 10:42
能不能把pcb贴上来看看撒
hui_hui0228 发表于 2011-1-19 10:26
显示没连接然后电源报这么多错误,我只碰到过3中情况,第一,打地孔把电源区给割断了,第二,每一次重新打开PCB的时候记得要铺铜,不然的话就没连接,第三,就是我之前说的那种情况了。。。我再想想有没有其他情况
xiaomayi 发表于 2011-1-18 22:33
检查连接性的问题建议所有的层数都要检查,不能单纯检查某一个层。不然容易出问题。连接性显示错误可能是你有的信号没有连接上,建议重新检查。或者是你分割铜皮的时候尖角没有处理好。最可能的问题是你板卡上没用的线头太多,建议你按o然后查看是否是这个问题。这类问题最好还是具体问题具体分析。
longfeisky 发表于 2011-1-18 16:49
本帖最后由 longfeisky 于 2011-1-18 16:50 编辑 ( z+ x' x! D2 e: Q" L

* V3 P& `6 Y1 x, H- T7 f我再摸索摸索
. r0 O+ g" B/ K
hui_hui0228 发表于 2011-1-18 14:06
你可以试一下嘛!你说的那样也可以,但是我就不知道为什么会出现你出现的那种情况了,我也是新手啊
longfeisky 发表于 2011-1-18 13:22
这样是不是不行啊
+ D# y# v$ K' t% t* s) H  c; n! w难道一定要花大的plane area 然后再画小的plane area
longfeisky 发表于 2011-1-18 13:18
我没有画大plane area ,全部都是小的plane area
5 S- Z% \8 T) O3 s每个电源都是分开的
hui_hui0228 发表于 2011-1-18 13:09
你是先画大的plane area ,还是先画里面很多的电源区域的?我以前也碰到过你说的情况,后来发现我是电源去顺序画反了,应该是先画大的plane area ,然后再在plane area 里画小块电源区域,如果先画小块电源区域,再画大的plane area 就会出现你说的情况,不知道楼主是不是跟我的情况一样
longfeisky 发表于 2011-1-18 12:06
在top层用couper
1 o0 ]6 Y1 O: y在内层,用plane area 然后灌铜
hui_hui0228 发表于 2011-1-18 11:45
电源你是先画的铜皮眶,还是先画的电源区域啊?
longfeisky 发表于 2011-1-18 11:35
明明连接上去了嘛
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