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标题: 2017年11月14日QA检查报告节选 [打印本页]

作者: EDA365QA    时间: 2017-11-15 09:51
标题: 2017年11月14日QA检查报告节选
1.等长未处理
7 W5 `- K( B. ~4 k" q  a/ m* P / f4 N0 L9 n" H- B) R( |3 [% M

作者: EDA365QA    时间: 2017-11-15 09:51
2.CLK没有按照规范等长- a1 p! Q' q* S% _

4 I. n. Z7 j& y. ?, u4 W- I
作者: EDA365QA    时间: 2017-11-15 09:52
3.隔离焊盘太大导致高速差分走线没有完整参考平面2 a$ r6 ]3 k$ U2 m" |: c! K3 D. f! }

9 f6 T# ~5 E- `' ^  x% u
作者: EDA365QA    时间: 2017-11-15 09:53
4.原理要求需要过大电流,加宽走线
% J9 x% H) O! [) o . W4 I% c# E! e

作者: EDA365QA    时间: 2017-11-15 09:53
5.LED极性反了
. T% l5 w5 [) r, b, A: B$ |- T 2 v8 w. G9 N- O3 U  b

作者: EDA365QA    时间: 2017-11-15 09:54
6.48V没做安规, }9 \: d' U# T1 J2 w2 K

' o5 r& K9 ^8 n1 q! r
作者: EDA365QA    时间: 2017-11-15 09:57
7.铜皮挖空大,距离板边15-20mil左右即可。- l1 L4 ?1 Z: A7 Y

  S8 g! }2 r! D  h9 s. |
作者: EDA365QA    时间: 2017-11-15 09:57
8.高低压做一下隔离处理8 |! d, Q' Y& Z

3 b& J& s; `0 m- q; o) e( }3 W
作者: EDA365QA    时间: 2017-11-15 09:58
9.隔离器件中间挖空处理. p# ]9 }$ G' {+ Z; n% A! {

1 Q1 ~8 [' p; ~/ ?! I
作者: EDA365QA    时间: 2017-11-15 09:58
10.CAN部分走差分
8 i$ Q5 X0 C6 ]/ Z$ Q  } " m" Y. E  ]  h* o* i

作者: EDA365QA    时间: 2017-11-15 09:59
本帖最后由 EDA365QA 于 2017-11-16 09:01 编辑 1 Y( N% p$ s# m6 V3 T
3 W6 O5 B% [1 u$ Z7 b
11.耳机线走8-10mil已经足够了,不要铺铜。
& i1 f* {, n: |' |0 X1 C3 S7 A
3 s6 H7 `% b3 J2 F
作者: EDA365QA    时间: 2017-11-15 09:59
12.尺寸标注有误差
1 L% e/ Y7 z( E " ]. q2 ]; o: Y6 I+ r. {% w- C# j

作者: 橡皮擦先生    时间: 2017-11-15 10:06
EDA365QA 发表于 2017-11-15 09:54" @" ]% i" n! t& b
6.48V没做安规

: l* [; I4 i! h% |$ J9 f5 ^谁能普及一下安规是什么
5 Z2 ]* z, i1 q$ X# `+ Y3 w5 {; m' |2 X5 a' F! H

作者: wx_SHOh21dw    时间: 2017-11-15 21:25
感谢分享
作者: cjz351421568    时间: 2017-11-17 00:09
这个是什么信号?
作者: cjz351421568    时间: 2017-11-17 00:09
这是什么信号
作者: 648638520    时间: 2017-11-17 09:22
感谢分享
作者: qilinwang66    时间: 2017-11-17 09:35

作者: 七彩雨    时间: 2017-12-1 15:24
这里为什么要做等长呢
作者: xueling2009    时间: 2017-12-20 16:43
EDA365QA 发表于 2017-11-15 09:53, o, {6 R% U! e; H/ L' Y/ }
5.LED极性反了
8 x/ F. J" u) g' O2 F
做的封装画的二极管的正负极和封封装上标的正极自相矛盾。+ U2 k2 D/ O: J: ^: E% R  J0 Z# H; y





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