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TLV62130降压DCDC使用求助

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发布时间: 2017-11-5 11:29

正文摘要:

2 y* N6 U" k3 B2 r; e ' }7 V# [* ~, O: E: u) |: Q. r ( e5 f: j. s, b1 L6 }6 u2 K0 U, x! y" C; @% D 最近有一个项目需要用到输出5V/3A的DCDC,于是选了一款:TLV62130,虽然看了规格书(见附件),但是有 ...

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huang8weijie 发表于 2018-5-3 18:31
; ^( t. X& S9 h4 |3 k
帮顶一下
yitong7601 发表于 2017-11-25 19:21
哪个正常的人能崇拜一只蟑螂呢?
wendell 发表于 2017-11-13 14:12
帮顶一下
weizai9212 发表于 2017-11-6 17:24
楼上两位正解。
AD9_PCB 发表于 2017-11-6 15:24
1、PG是电源电压好坏状态指示脚,内部开漏模式,需外加上拉电阻。上拉电阻之后高电平标示输出电压正常,低电平标示输出电压不正常。
3 O# f1 s6 t& n) d" Y2、DEF 标示输出电压精度,将此脚拉低,输出精度高,拉高,输出精度+-5%
7 h6 |* w! q; i/ i3、VOS 表示输出电压探测脚,探测输出电压同时对内部电路补偿校准。# P7 Z) n/ o* k* f- l  z/ P+ E
4、UVLO 术语:under voltage lock out 低压锁存输出。就是输入欠压保护。
AD9_PCB 发表于 2017-11-6 15:19
1、PG是电源电压好坏状态指示脚,内部开漏模式,需外加上拉电阻。上拉电阻之后高电平标示输出电压正常,低电平标示输出电压不正常。
Aubrey 发表于 2017-11-6 10:42
PG: 即DC/DC常见的Power Good信号,是输出电压检测信号,开漏(open-drain)所以要上拉,电压输出异常时被拉低。
* K, L; K$ d: H. M" ~+ y( YDEF脚:规格书上说了,选择正常电压输出你就把该脚接地,选择正常电压5%范围就拉高它。一般接GND。
9 `5 w  m( A! CVOS:即Output Voltage Sense,环路控制的一部分,按参考图纸接。2 q8 `& _' j1 c1 b: T
UVLO:Under Voltage Lock Out ,低电压锁定。是供电电压低于IC的开启门限电压时的一种保护模式,具体是UVLO的迟滞功能来减少IC激活频率。2 G( N6 v- O' d3 e3 b0 a
yhg-cad 发表于 2017-11-6 00:18
UVLO  规格书上有写的啊,最低输入电压。应该 就是最低启动电压吧
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