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allegro pcb中两对差分线之间的间距约束怎么设置

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norato

发布时间: 2016-9-5 15:29

正文摘要:

如题，差分线之间的间距约束怎么设置

qinhappy 发表于 2016-9-7 11:24

设网络间最小间距。

AD9_PCB 发表于 2016-9-7 09:37

重申一下，3楼方法可行，但是怎么设置其他单根线与差分对的间距呢？我按照刚才的方式吧刚才的规则放到一个单根线网络上，发现不行啊

AD9_PCB 发表于 2016-9-7 09:25

3楼的回答应该是差分线之间的间距吧？而不是差分线对1和差分线对2之间的间距.我以前也设置过，可是不行

li262925 发表于 2016-9-6 13:28

支持3#

why_not 发表于 2016-9-5 17:01

在 spacing - spacing constraint set 下点击 Greate -spacing 设置上自己想要设置的间距，然后再在net目录下点开ALL Layers。Objects 内选中想要设置差分线的网络在 Referenced Spacing C set 下拉选项中选中刚刚刚创建好的间距就可以了！

瓜郎 发表于 2016-9-5 16:52

约束管理器里面有设置啊

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