恩,好的。谢谢。 |
对Pin Delay无影响,具体影响看Downrev.log |
dzkcool 发表于 2014-12-26 10:33' @: R' v, y9 m; ~ 哦。谢谢版主,另外想请问一下,档案降了版本后会影响吗?比如说我从16.6降到16.3以后再操作会有异常吗?感谢!!( e+ B) ?' h* q& ~3 G2 F% | |
在Excel里面看也可以,Allegro里面可以用查询Pin的功能看报表。# `' H: M& e; E+ D3 U 导入Pin Delay无非就是为了等长,既然要做等长,那就把等长规则设上就好了,设上以后就可以直观的看到了。 |
dzkcool 发表于 2014-12-25 18:08 没有什么目的,就是想知道可不可以?版主。 |
先说一下你的目的。 |
dzkcool 发表于 2014-12-25 16:10- Q" ]% o- e/ H# B 啊。那有办法在设置match group之前显示出来吗? |
BUS上是不会显示的,要设置等长规则后才会出现。 |
dzkcool 发表于 2014-12-24 15:156 G# w: ]0 ~! Q; d 导入进去了不显示。不知道是不是还有其它的设置呢? |
dzkcool 发表于 2014-12-24 15:15- U. F1 K+ \: ^7 {& E) p 好的。谢谢版主。我试试。 |
首先PIN delay数据文件扩展名为csv,可以用Excel编辑后另存为csv文件,格式为一列管脚编号,一列长度; 在Allegro中File->Import->Pin Delay,选择文件,点击对应器件,单击Import按钮。/ p, t1 W; r, {- M. [& f/ o' y 在Constraint Manager中,Analyze->Analysis Modes,打开Electrical Optoins,勾选Pin Delay下的选项,单击ok使规则生效。 |
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