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2017年7月6日公益PCB评审报告节选(一)

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发表于 2017-7-7 08:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-7-7 09:17 编辑
7 U& `7 N8 z) F' |) t; q: @
- w1 ~* Q+ O5 M1 T# `4 A1.  隔层参考没对应布线.
7 u- Q- A% D4 R( t+ T3 P ' J8 M' z. ^3 D- C$ K% l- t# Y% z
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发表于 2017-7-27 17:09 | 只看该作者
junieya 发表于 2017-7-27 16:22# m+ J. S5 O2 @" E3 d% J
隔离处理就是画出来的地方的电路元件要离电感远一点嘛?

5 L% N- e6 b2 c9 A9 P) H1 |+ Q隔离这类名词要多学习多看一些资料,下面是EMC方面的说法.
! L- q8 l* Y3 k1 m: ~" V5 f & X, g* [! o1 A! P5 J' i/ a$ P

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发表于 2017-7-27 16:22 | 只看该作者
EDA365QA 发表于 2017-7-7 08:529 \" X% o% J: g  C7 H
4.  共模电感前后做隔离处理.

" \9 V9 N! ~, {% t) A; N$ W6 E$ D隔离处理就是画出来的地方的电路元件要离电感远一点嘛?4 h* K/ n! ^9 E8 S/ R

点评

pcb
隔离这类名词要多学习多看一些资料,下面是EMC方面的说法. [attachimg]129100[/attachimg]  详情 回复 发表于 2017-7-27 17:09

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 楼主| 发表于 2017-7-7 08:56 | 只看该作者
6.  隔离的电源地分割要一致,不能有跨分割布线.) A7 d8 _" X6 q2 C
/ z7 a! S4 P8 P8 W4 u

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 楼主| 发表于 2017-7-7 08:49 | 只看该作者
2.  有多余线段.$ t/ s8 j* B+ v9 b8 `: m
4 h1 A9 ~$ e4 V3 `) W0 V; }

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 楼主| 发表于 2017-7-7 08:51 | 只看该作者
3.  加热部分为大电流,布线应铺铜加宽.! L  V; O6 a8 o+ {# W! c6 S( I

  v0 c; X6 K$ r. Y6 P  R, g

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 楼主| 发表于 2017-7-7 08:52 | 只看该作者
4.  共模电感前后做隔离处理.
; ^* a6 C) V  _0 N. m, Q# C  T- Z ' J/ c& z/ U. |# Q  l

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隔离处理就是画出来的地方的电路元件要离电感远一点嘛?  详情 回复 发表于 2017-7-27 16:22

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 楼主| 发表于 2017-7-7 08:54 | 只看该作者
5.  共模电感所有层前后做隔离.
- |. ^9 ^- X8 t' }& O
- E9 E3 n" h; J

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 楼主| 发表于 2017-7-7 08:57 | 只看该作者
7.  光耦前后做隔离.
) S/ W6 e7 e1 ]0 K
& \3 ]. A* m% j; a9 j/ g9 Z

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 楼主| 发表于 2017-7-7 08:58 | 只看该作者
8.  DDR的DQS没走差分.
% r+ {7 j0 Z9 V, D+ B
) [4 H9 h) B/ {

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 楼主| 发表于 2017-7-7 08:59 | 只看该作者
9.  差分走线不耦合太长了.& v1 g+ i  `; v: @! r
) y$ B9 i# P: t$ X; g

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 楼主| 发表于 2017-7-7 09:00 | 只看该作者
10.  电源电感两端走线要加宽.4 h3 |! M% P' V0 o4 t+ @3 h, k: Z

! F( N6 A0 D8 d' ]9 \

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发表于 2017-7-7 09:02 | 只看该作者
细节上能见真功夫呀。

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发表于 2017-7-7 09:04 | 只看该作者
:)

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发表于 2017-7-7 09:44 | 只看该作者
謝謝分享

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发表于 2017-7-7 12:25 | 只看该作者
可以学习,还可以加分,幸福

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发表于 2017-7-7 14:22 | 只看该作者
以后我画好板子也要发给EDA365的各位版主帮忙评审。
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