答题 | 没有测试的人生不完美

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/ f/ @) X3 x0 ]6 G% I9 f( m  ]. X$ @没有测试的人生不完美
0 y: V: W3 o* C【文：刘丽娟】

6 t1 U* i! r: {/ |( L3 j4 r（戳标题，即可查看上期文章回顾）
% X. h6 N; A) ~9 l, c; T问答从本周起，我们会花几周的时间专门聊聊测试那些事儿，大家有什么关心的话题吗？
这周的文章是接下来几周测试话题的引言，从大家的反馈看，既有完全的测试小白，也有已经在门内的专业测试工程师。想要面面俱到讲完所有的仪器、测试理论&实例，怕是要开个线下的学习班才行呐。

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小编会综合大家的反馈，从中挑选最受关注的话题开始讲起，尽量兼顾小白和大拿，若有未详尽之处，还望雅正（ren zhe）


（以下内容选自部分网友答题）
7 M; N" o, \( _4 U) I7 q- I首先，感兴趣的pcb的生产飞针测试如何进行？其次就是S参数测试，测试后波形怎么分析，如何指导改进。S参数代表的意义等
3 @. {+ }) f5 X4 n@ Jamie
评分：2分
* q- \1 G  q9 s( \0 D3 t& A建议高速先生普及下关于测试的知识：【1】、PCB测试点的设计规范要求具体有哪些？【2】、板厂出货前PCB测试流程是怎样的？【3】、测试夹具制作要点和注意事项有哪些？【4】、还有示波器测试波形时序、重点讲下眼图测试  【5】、用TDR测试阻抗.【6】、矢量网络分析仪测S参数。【7】、高速连接器如何测试·【8】DDR系列测试等最好有案例来讲解步骤和分析数据。   
@ 龍鳳呈祥
1 d3 y8 c5 `) F评分：3分
8 x3 B! H: k& }1 B7 q. lwifi等信号如何测试阻抗，测试走线的起点和终点分别在哪？  
* d3 [3 r$ o1 c8 _: U@ 涌
7 i" `* f1 L+ p6 Z5 s' P7 C评分：2分
+ ]- Z/ d& M) P* z" r0 O1.每当线路板在测试部门测试不通过时，每当产品在客户处作系统调试不通过时，测试才被我们关心起来。根据测试员的建议来排查PCB画图问题，大到封装拓扑的空间布局，小到过孔导线的拐弯末角，结果，都要修改并导出歌波，重新发板厂制板。所以画图员就特别钦佩测试员，仪器架设，产品通电，手握探针迹线点点，眼盯屏幕随波变变。从像天书一样的坐标图形中捕捉转瞬即逝的跳动，从密密麻麻的按键旋钮上测量难分伯仲的差异。窗外清风吹来，紧锁的眉头慢慢舒展，指着板对我说，这里优化，那边修改。2.有时我在想，若我也了解一点测试的知识，也不至于每次和测试员交流时只是那三个字“好的，诺”。这次高速先生推出测试专题，我很高兴。想了解：示波器测波形，TDR阻抗，S参数测试的知识。
@ 山水江南
9 p. t3 |+ F! S. g评分：3分
怎样看频域波形
@ ZF
评分：2分
/ N  z1 p6 ?4 C9 o" h网络分析仪怎么测阻抗？
@ vision
! F7 [# L/ {! Z: N1 J8 q9 m评分：2分
! @. s/ H  ]* S' w" [6 @1 V9 G没有测试的人生不完美，讲不明白方法的小编不可爱。拿到硬件测测开短路看看电源时钟输出这种简单的就不要讲了吃瓜群众混了这么多年也该看会了，多讲讲如何通过一个波形或是频谱定位分析问题找寻真相吧，就像行文所说好的波形千篇一律，有问题的才是值得讲解讲解的。
@ Vincent
评分：2分
! z' w( x; v/ G7 H$ b$ {6 m# L3 S, J5 |硬件总是说，哎你这SI/PI测试fail了算毛啊，我压力测试杠杠的过；或者就是SI/PI测试fail多少个%才必须要改；工作背景一般的总不在乎板级测试，没法沟通，好多做产品的总是没那么重视只觉得可靠性过了就行，这个就搞得我很郁闷。
3 L) }. w0 Y. H1 K; w7 \@ wangxj
4 G5 ?& {4 w. h; V6 s. w: o) L/ U评分：2分
请讲解一下测试的具体步骤、需要测试哪些参数、如何看懂波形及如何从波形上判断信号质量。感谢！
@ 项
评分：2分
2 c2 [3 h7 k( Y! V- s' T$ H一般的S参数大家都知道，除了s参数还有相位之类的，一直没搞懂。还有有源测试除了眼图，还有误码测试，也可以讲讲。
@ 两处闲愁
评分：2分
想研究电机的测试，还有一些协议测试。这些对硬件来说也是重要的一还。  
4 w7 f  b7 D4 s/ L@ moody
评分：2分
; U/ N, I9 ?: {3 M) v7 B7 W! }0 G完全小白，能否全面讲讲各种测试仪器作用以及这些结果意味着什么？怎么改善？
@ 漂_泊Mark
评分：2分
. d% |) j/ U' a4 o  }) U% H" }. N做测试其实也很苦恼，USB3.0/PCIE3.0接收
1，端眼图明明已经压了，可对业务貌似没有影响，开发就补处理了，也不分析是均衡的影响呢，还是业务压力不够。
5 H" ~$ _& G4 B+ E2，随意信号频率的上升，如PCIE4.0,DDR4等，示波器的测试效果对测试点位置要求更高，实际该类信号chip to  chip也比较多，感觉示波器测试也力不从心了。
+ @( l9 A  C4 M  L3，各类总线的眼图及结果fail的测试项目，如何分析具体线路上哪个设计影响的。
4，随意信号频率也来越高，没有特定夹具下，示波器等仪器的必要性？  
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@ hk