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2017年10月15日QA检查报告节选

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发表于 2017-10-16 08:52 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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2017年10月15日QA检查报告节选
3 l% T5 c# A/ a* d; c% d- [- y

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1.有线没参考面.jpg
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 楼主| 发表于 2017-10-16 08:53 | 只看该作者
6.电阻两端走类差分,还有很多相同模块。
* T# ]9 w5 N0 b5 ]
4 s6 l3 [" I( D; p

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 楼主| 发表于 2017-10-16 08:54 | 只看该作者
10.线尽量不要与保护地重叠  |' q1 C) k$ V  C' J

  ?' |. V0 i3 [) C

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 楼主| 发表于 2017-10-16 08:54 | 只看该作者
9.正负75V孔与铜间距加大) B% O/ V7 m- g/ \
" d/ C5 ?6 i1 `- ?  q  T' [7 b

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 楼主| 发表于 2017-10-16 08:52 | 只看该作者
``
0 ]& s) Q9 j  r8 I1 @4 M+ ^

2.电阻两端等长.jpg (110.76 KB, 下载次数: 1)

2.电阻两端等长.jpg

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``, t$ j) R  c0 }# c7 U

3.VIA多余.jpg (80.21 KB, 下载次数: 2)

3.VIA多余.jpg

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``6 D  ?. u7 s) ?( [, l  E

4.SDRAM的线跨分割.jpg (76.09 KB, 下载次数: 0)

4.SDRAM的线跨分割.jpg

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5.中心线加粗- K1 i5 R) @2 b! [+ ~
/ D4 b$ T8 M' q$ v0 r

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7.时钟不要拉出残端/ T- x7 ]; O, L- w

4 `, D+ @% {- ?  V% J4 T

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 楼主| 发表于 2017-10-16 08:54 | 只看该作者
8.电源加粗
: ]1 Y, H) i1 `; g; k5 F
, B$ c5 T7 y; n+ O: u4 f; l

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11.换层处电源加VIA
" V4 N5 I3 {" Z8 E) u
8 ?% W# Q  k9 z- J' X

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`` " t6 ~" O1 O% `& b8 R# _. `

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