DDR高速电路怎样更好的控制EMI呢?

sinow · 发表于 2011-4-21 22:20

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MID 的CPU 带有两个DDR2 800M 但在整机测试EMI 不加屏蔽的情况下过不了,请问大家在PCB Layout 的时有没有什么要改善的?

sinow · 发表于 2011-4-21 22:21

主要是针对EMI 测试,大家有没有什么好的见意?

cccccc32 · 发表于 2011-4-22 09:32

帮顶！！！！！！！！

kaenii · 发表于 2011-5-1 16:06

注意差分时钟的布线，用地线包起来。
注意信号线的阻抗连续性，参考平面要注意。
信号的过冲厉害也会带来一定的EMI问题。

linbanyon · 发表于 2018-6-12 13:16

谢谢

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