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多层电路图端口链接老是出问题

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发表于 2016-6-19 21:34 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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( r+ n$ C+ j% X老是出些警告和报错
+ }1 P) i+ M6 C6 O, }8 p! tDVCC contains Output Port and Bidirectional Port objects (Port DVCC,Port DVCC), R0 _! r6 @7 K; `

- G, B  B7 b& z, ~4 v/ z8 r, E! B8 d3 c7 B4 D5 K  r

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 楼主| 发表于 2016-6-19 21:35 | 只看该作者
harness type是什么类型呢?

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 楼主| 发表于 2016-6-19 21:42 | 只看该作者
刚才自己摸索了,这种端口至少三处一致性,即:sheet symbol1, sheet symbol2,  具体图纸中的端口port

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发表于 2016-6-20 08:47 | 只看该作者
同页原理图不需要这个链接,不同也才需要的

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不同页面原理图  详情 回复 发表于 2016-6-20 11:58

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 楼主| 发表于 2016-6-20 11:58 | 只看该作者
980155498cai 发表于 2016-6-20 08:47
) D4 W2 e9 L) j# X1 ~/ E7 t同页原理图不需要这个链接,不同也才需要的

7 ^' K" O+ I% _. l- G4 H不同页面原理图
. y1 b' Z* v+ B9 }3 A% Z2 c

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不同页使用port链接  详情 回复 发表于 2016-6-20 12:04

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发表于 2016-6-20 12:04 | 只看该作者
zhanweiming2014 发表于 2016-6-20 11:58
& N- s" h3 y. e% }$ s0 {0 j% Q' @: o不同页面原理图
' [% |/ o. [/ ^" n, u0 a
不同页使用port链接3 ?) [3 o! Z7 z' z8 Q* X! W

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发表于 2016-6-21 15:32 | 只看该作者
这个我估计是不会太懂得

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多人同时开发项目时候,就会使用到  详情 回复 发表于 2016-6-21 19:19

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 楼主| 发表于 2016-6-21 19:19 | 只看该作者
realnol 发表于 2016-6-21 15:32
# \# m- l# W) h# B这个我估计是不会太懂得

! |( r/ E% n0 }  j. P多人同时开发项目时候,就会使用到+ w4 `$ P3 ]) l
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