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2017年11月25日QA检查报告节选

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发表于 2017-11-27 11:37 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.所有层完全隔开
+ r4 b$ C7 u5 H4 p! @ & f4 j# M+ C6 p! l
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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
2.保护地是否接到孔上
! {; ], w& |3 L$ }; A0 `% e
0 ?3 R4 i- |6 p% J" w

点评

我现在做的产品电路板固定支架都是金属的,我都不把GND连到过孔上的。连不连有什么好处和坏处吗?  详情 回复 发表于 2017-11-29 11:21

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
3.视频模拟线包地处理% l$ h; V0 g1 o
# s& m2 {& ?5 G

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
4.跨分割了
0 u7 R: q: a  u3 B! B* n% @
/ z; O4 L3 r0 [5 K5 F- T+ F% W

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
5.电源PIN没加粗
5 {1 z! T9 i* ^3 C 9 w. s% e6 [2 K) ^

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 楼主| 发表于 2017-11-27 11:38 | 只看该作者
6.没有按照差分线处理" n6 q; b9 ~* U3 t4 K

4 D/ I: W: r) E" |, r

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
7.DDR的差分走线需要优化处理. @& }; R$ V+ T( O

* i1 `2 x) T/ f9 z

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
8.二极管封装与原理图不一致
% O& }5 x. [; C/ ~+ W& ~' b 5 a. S1 N. c& R7 y6 B6 D6 x

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
9.光耦前后做隔离
, k% F8 u) o, ^+ ]
8 {& i: r0 J% \

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 楼主| 发表于 2017-11-27 11:39 | 只看该作者
10.VCC通道小了* ^* K: G8 Q  Y/ k& P% ^! o

4 o2 N# s4 z; m" g

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 楼主| 发表于 2017-11-27 11:40 | 只看该作者
11.电源几个点不要铺一个平面1 J5 {) c) H) t) g2 t
+ g( M9 G. }) B7 Q

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发表于 2017-11-29 11:19 | 只看该作者
这个是什么器件啊,需要所有层全部隔开?

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发表于 2017-11-29 11:21 | 只看该作者
EDA365QA 发表于 2017-11-27 11:38
$ M& D# V$ T2 {" K/ m" I2.保护地是否接到孔上
; n  r% h, i9 F, m, |9 z
我现在做的产品电路板固定支架都是金属的,我都不把GND连到过孔上的。连不连有什么好处和坏处吗?

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发表于 2017-12-1 09:40 | 只看该作者
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